參數(shù)資料
型號： S1C33L17B00E100
元件分類： 微控制器/微處理器
英文描述： MICROCONTROLLER, PBGA180
封裝： 12 X 12 MM, 1.2 MM HEIGHT, 0.80 MM PITCH, PLASTIC, BGA-180
文件頁數(shù)： 892/1026頁
文件大?。?/td> 12570K
代理商： S1C33L17B00E100
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iXPeRiPheRaLMoDuLes7(usB):usBFunCtionContRoLLeR(usB)
iX-1-92
ePson
s1C33L17teChniCaLManuaL
0x300980:CPu_JoinRd(CPuJoinFiFoRead)
name
address
Registername
Bit
setting
init. R/W
Remarks
–
JoinePdRd
JoinePcRd
JoinePbRd
JoinePaRd
D7–4
D3
D2
D1
D0
–
0
–
R/W
0 when being read.
00300980
(B)
–
1 JoinEPcFIFOread
0 Donothing
1 JoinEPbFIFOread
0 Donothing
1 JoinEPaFIFOread
0 Donothing
CPu_JoinRd
(CPujoinFiFo
read)
1 JoinEPdFIFOread
0 Donothing
This register can be set up to read the FIFO data of the endpoint through the CPU Interface. When the
EPnFIFOforCPU register is read after the setup of this register is completed, the FIFO data of the relevant endpoint
can be read. The remained data quantity of the FIFO can be referred by the EPnRdRemain_H, L register.
This register can set only one bit to 1 at the same time. When 1 is written into multiple bits at the same time,
writing in higher order bit is regarded as valid. When all bits are set to 0, EP0 will be joined.
The reading data from CPU I/F through the endpoint used by USB I/F or DMA I/F is not allowed.
If CPU I/F needs to read from the IN direction endpoint, use the ForceNAK bit to avoid reading data from USB I/F.
If CPU I/F needs to read from the OUT direction endpoint, check the DMA_Running bit of the DMA_Control
register to avoid reading data from DMA I/F at the same time.
This register is valid when EnEPnFIFO_Access.EnEPnFIFO_Rd bit is set.
D[7:4]
Reserved
D3
JoinePdRd
If this bit is set to 1, the FIFO data of the endpoint EPd can be read from the EPnFIFOforCPU register.
In addition, reference to the data quantity in the FIFO of the endpoint EPd by the EPnRdRemain_H, L
register is enabled.
D2
JoinePcRd
If this bit is set to 1, the FIFO data of the endpoint EPc can be read from the EPnFIFOforCPU register.
In addition, reference to the data quantity in the FIFO of the endpoint EPc by the EPnRdRemain_H, L
register is enabled.
D1
JoinePbRd
If this bit is set to 1, the FIFO data of the endpoint EPb can be read from the EPnFIFOforCPU register.
In addition, reference to the data quantity in the FIFO of the endpoint EPb by the EPnRdRemain_H, L
register is enabled.
D0
JoinePaRd
If this bit is set to 1, the FIFO data of the endpoint EPa can be read from the EPnFIFOforCPU register.
In addition, reference to the data quantity in the FIFO of the endpoint EPa by the EPnRdRemain_H, L
register is enabled.
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