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參數資料
| 型號： | S1C33L17B00E100 |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | MICROCONTROLLER, PBGA180 |
| 封裝： | 12 X 12 MM, 1.2 MM HEIGHT, 0.80 MM PITCH, PLASTIC, BGA-180 |
| 文件頁數： | 804/1026頁 |
| 文件大?。?/td> | 12570K |
| 代理商： | S1C33L17B00E100 |
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iXPeRiPheRaLMoDuLes7(usB):usBFunCtionContRoLLeR(usB)
s1C33L17teChniCaLManuaL
ePson
iX-1-13
IX
USB
Controltransfer
Control transfer on the EP0 endpoint is controlled as a combination of a number of discrete transactions. Figure
IX.1.4.1.4 illustrates how control transfer is executed for an OUT data stage.
(a) The host starts control transfer in a SETUP transaction. The device's firmware analyzes the request contents
to prepare for responding to a data stage.
(b) The host issues an OUT transaction and executes a data stage, and the device receives data.
(c) The host issues an IN transaction and executes a status stage, and the device returns a zero-length data
packet.
Control transfer without a data stage is executed as in this example but without the data stage.
Transition to a status stage is triggered by an issuance of a transaction by the host whose direction is opposite to
that of the data stage. Have your firmware monitor an IN_TranNAK status (EP0IntStat.IN_TranNAK bit) as a
trigger to transit to a status stage from a data stage.
a
b
c
HosttoDevice
DevicetoHost
FigureIX.1.4.1.4ControlTransferHavinganOUTDataStage
Figure IX.1.4.1.5 illustrates how control transfer is executed for an IN data stage.
(a) The host starts control transfer in a SETUP transaction. The device's firmware analyzes the request contents
to prepare for responding to a data stage.
(b) The host issues an IN transaction and executes a data stage, and the device transmits data.
(c) The host issues an OUT transaction and executes a status stage, and the device returns an ACK response.
Transition to a status stage is triggered by an issuance of a transaction by the host whose direction is opposite to
that of the data stage. Have your firmware monitor an OUT_TranNAK status (EP0IntStat.OUT_TranNAK bit)
as a trigger to transit to a status stage from a data stage.
a
b
c
HosttoDevice
DevicetoHost
FigureIX.1.4.1.5ControlTransferHavinganINDataStage
Since status and data stages in control transfer execute ordinary OUT and IN transactions, flow control using
NAK responses works effectively. The device is allowed to prepare for returning responses within a specified
time frame.
相關PDF資料 |
PDF描述 |
|---|---|
| S1C33T01F0A0100 | 32-BIT, FLASH, 60 MHz, RISC MICROCONTROLLER, PQFP176 |
| S1C38000B0A0100 | 32-BIT, RISC MICROCONTROLLER, BGA239 |
| S1C60L02F | 4-BIT, MROM, 0.08 MHz, MICROCONTROLLER, PQFP60 |
| S1C60L05F | 4-BIT, MROM, 0.08 MHz, MICROCONTROLLER, PQFP60 |
| S1C60L05D | 4-BIT, MROM, 0.08 MHz, MICROCONTROLLER, UUC53 |
相關代理商/技術參數 |
參數描述 |
|---|---|
| S1C33L17D00A000 | 制造商:Seiko Instruments Inc (SII) 功能描述:IC 32BIT MCU 33L17 DIE FORM |
| S1C33L19 | 制造商:EPSON 制造商全稱:EPSON 功能描述:CMOS 32-bit application Specific Controller |
| S1C33L26 | 制造商:EPSON 制造商全稱:EPSON 功能描述:CMOS 32-bit Application Specific Controller |
| S1C33L27 | 制造商:EPSON 制造商全稱:EPSON 功能描述:CMOS 32-bit Application Specific Controller |
| S1C33S01 | 制造商:EPSON 制造商全稱:EPSON 功能描述:32-bit Single Chip Microcontroller |
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