參數(shù)資料
型號(hào)： S1C33L17B00E100
元件分類(lèi)： 微控制器/微處理器
英文描述： MICROCONTROLLER, PBGA180
封裝： 12 X 12 MM, 1.2 MM HEIGHT, 0.80 MM PITCH, PLASTIC, BGA-180
文件頁(yè)數(shù)： 521/1026頁(yè)
文件大小： 12570K
代理商： S1C33L17B00E100
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V PeRiPheRaL MoDuLes 3 (inteRFaCe): GeneRaL-PuRPose seRiaL inteRFaCe (eFsio)
s1C33L17 teChniCaL ManuaL
ePson
V-1-45
V
EFSIO
0x300B03–0x300B13: serial i/F Ch.x Control Registers (peFsiFx_CtL)
name
address
Register name
Bit
Function
setting
init. R/W
Remarks
tXenx
RXenx
ePRx
PMDx
stPBx
ssCKx
sMDx1
sMDx0
D7
D6
D5
D4
D3
D2
D1
D0
Ch.x transmit enable
Ch.x receive enable
Ch.x parity enable
Ch.x parity mode select
Ch.x stop bit select
Ch.x input clock select
Ch.x transfer mode select
11
10
01
00
SMDx[1:0]
Transfer mode
8-bit asynchronous
7-bit asynchronous
Clock sync. Slave
Clock sync. Master
0
X
R/W
Valid only in
asynchronous mode.
00300B03
|
00300B13
(B)
1 Enabled
0 Disabled
1 Enabled
0 Disabled
1 With parity 0 No parity
1 Odd
0 Even
1 2 bits
0 1 bit
1 #SCLKx
0 Internal clock
serial i/F Ch.x
control register
(pEFSIFx_CTL)
note: The letter ‘x’ in bit names, etc., denotes a channel number from 0 to 1.
0x300B03
Serial I/F Ch.0 Control Register (pEFSIF0_CTL)
0x300B13
Serial I/F Ch.1 Control Register (pEFSIF1_CTL)
D7
tXenx: serial i/F Ch.x transmit enable Bit
Enables each channel for transmit operations.
1 (R/W): Transmit enabled
0 (R/W): Transmit disabled (default)
When TXENx for a channel is set to 1, the channel is enabled for transmit operations. When TXENx is
set to 0, the channel is disabled for transmit operations.
Always make sure TXENx = 0 before setting the transfer mode and other conditions.
Writing 0 to TXENx clears the transmit data buffer (FIFO) as well as disabling transmit operations.
D6
RXenx: serial i/F Ch.x Receive enable Bit
Enables each channel for receive operations.
1 (R/W): Receive enabled
0 (R/W): Receive disabled (default)
When RXENx for a channel is set to 1, the channel is enabled for receive operations. When RXENx is
set to 0, the channel is disabled for receive operations.
Always make sure RXENx = 0 before setting the transfer mode and other conditions.
Writing 0 to RXENx clears the receive data buffer (FIFO) as well as disabling receive operations.
D5
ePRx: serial i/F Ch.x Parity enable Bit
Selects a parity function for asynchronous transfer. (Default: indeterminate)
1 (R/W): Parity added
0 (R/W): No parity added
EPRx is used to select whether receive data is to be checked for parity, and whether a parity bit is to be
added to transmit data. When EPRx is set to 1, the receive data is checked for parity. A parity bit is au-
tomatically added to the transmit data. When EPRx is set to 0, parity is not checked and no parity bit is
added.
EPRx is only effective in asynchronous mode. Settings of EPRx have no effect in clock-synchronized
mode. In ISO7816 mode, the parity function is always enabled no matter how EPRx is set.
相關(guān)PDF資料
PDF描述
S1C33T01F0A0100 32-BIT, FLASH, 60 MHz, RISC MICROCONTROLLER, PQFP176
S1C38000B0A0100 32-BIT, RISC MICROCONTROLLER, BGA239
S1C60L02F 4-BIT, MROM, 0.08 MHz, MICROCONTROLLER, PQFP60
S1C60L05F 4-BIT, MROM, 0.08 MHz, MICROCONTROLLER, PQFP60
S1C60L05D 4-BIT, MROM, 0.08 MHz, MICROCONTROLLER, UUC53
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
S1C33L17D00A000 制造商:Seiko Instruments Inc (SII) 功能描述:IC 32BIT MCU 33L17 DIE FORM
S1C33L19 制造商:EPSON 制造商全稱(chēng):EPSON 功能描述:CMOS 32-bit application Specific Controller
S1C33L26 制造商:EPSON 制造商全稱(chēng):EPSON 功能描述:CMOS 32-bit Application Specific Controller
S1C33L27 制造商:EPSON 制造商全稱(chēng):EPSON 功能描述:CMOS 32-bit Application Specific Controller
S1C33S01 制造商:EPSON 制造商全稱(chēng):EPSON 功能描述:32-bit Single Chip Microcontroller
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