參數(shù)資料
型號： S1C33L17B00E100
元件分類： 微控制器/微處理器
英文描述： MICROCONTROLLER, PBGA180
封裝： 12 X 12 MM, 1.2 MM HEIGHT, 0.80 MM PITCH, PLASTIC, BGA-180
文件頁數(shù)： 1024/1026頁
文件大小： 12570K
代理商： S1C33L17B00E100
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aPPendix B diFFeRenCes BetWeen C33 Pe CoRe and otheR C33 CoRe
s1C33L17 teChniCaL ManuaL
ePson
aP-B-1
AP
C33PE
Appendix B Differences Between C33 PE
Core and Other C33 Core
The functions below have been added to or changed for the C33 PE Core, based on functions of the C33 STD Core
CPU (S1C33000). For details, see the “S1C33 Family C33 PE Core Manual.”
B.1 instructions
The C33 PE Core instruction set is compatible with the C33 STD Core CPU, note, however, that some existing
instructions have been function extended or removed and new instructions have been added for high-performance
operations and cost reduction.
Function-extended instructions
The C33 PE Core has the following function-extended instructions.
1. The number of bits shifted by shift/rotate instructions has been increased from 8 to 32.
shift
%rd,imm5
0–8 bits shift
→ 0–32 bits shift, shift = srl, sll, sra, sla, rr, rl
shift
%rd,%rs
0–8 bits shift
→ 0–32 bits shift, shift = srl, sll, sra, sla, rr, rl
2. The data transfer instructions between a general-purpose register and a special register have been modified
to support newly added special registers.
ld.w
%sd,%rs
Special register specifiable in %sd added
ld.w
%rd,%ss
Special register specifiable in %ss added
added instructions
The instructions added to the C33 PE Core are listed below.
1. Instructions specifically designed to save and restore single or special registers have been added.
push
%rs
Pushes single register
pop
%rd
Pops single register
pushs
%ss
Pushes special registers successively
pops
%sd
Pops special registers successively
2. Instructions specifically designed for use with the coprocessor interface have been added.
ld.c
%rd,imm4
Coprocessor data transfer
ld.c
imm4,%rs
Coprocessor data transfer
do.c
imm6
Coprocessor execution
ld.cf
Coprocessor flag transfer
3. Other special instructions have been added.
swaph
%rd,%rs
Switches between big and little endians
psrset imm5
Sets the PSR bit
psrclr imm5
Clears the PSR bit
jpr
%rb
Register indirect unconditional relative branch
instructions removed
In the C33 PE Core, the instructions listed below have been removed from the instruction set of the C33 STD
Core CPU.
div0s
Preprocessing for signed step division
div0u
Preprocessing for unsigned step division
div1
Step division
div2s
Correction of the result of signed step division, 1
div3s
Correction of the result of signed step division, 2
mac
Multiply-accumulate operation
scan0
Scan bits for 0
scan1
Scan bits for 1
mirror
Mirroring
These functions can be realized using the software library provided or by other means.
相關(guān)PDF資料
PDF描述
S1C33T01F0A0100 32-BIT, FLASH, 60 MHz, RISC MICROCONTROLLER, PQFP176
S1C38000B0A0100 32-BIT, RISC MICROCONTROLLER, BGA239
S1C60L02F 4-BIT, MROM, 0.08 MHz, MICROCONTROLLER, PQFP60
S1C60L05F 4-BIT, MROM, 0.08 MHz, MICROCONTROLLER, PQFP60
S1C60L05D 4-BIT, MROM, 0.08 MHz, MICROCONTROLLER, UUC53
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S1C33L26 制造商:EPSON 制造商全稱:EPSON 功能描述:CMOS 32-bit Application Specific Controller
S1C33L27 制造商:EPSON 制造商全稱:EPSON 功能描述:CMOS 32-bit Application Specific Controller
S1C33S01 制造商:EPSON 制造商全稱:EPSON 功能描述:32-bit Single Chip Microcontroller
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