參數(shù)資料
型號(hào)： S1C33L17B00E100
元件分類(lèi)： 微控制器/微處理器
英文描述： MICROCONTROLLER, PBGA180
封裝： 12 X 12 MM, 1.2 MM HEIGHT, 0.80 MM PITCH, PLASTIC, BGA-180
文件頁(yè)數(shù)： 131/1026頁(yè)
文件大?。?/td> 12570K
代理商： S1C33L17B00E100
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iiBusModuLes:high-sPeeddMa(hsdMa)
ii-1-46
ePson
s1C33L17teChniCaLManuaL
ii.1.10Precautions
When setting the transfer conditions, always make sure the DMA controller is inactive (HSx_EN (D0/0x30112C
+ 0x10x) = 0).
hsx_en:Ch.xEnableBitintheHSDMACh.xEnableRegister(D0/0x30112C+0x10x)
After an initial reset, the cause-of-interrupt flag (FHDMx (Dx/0x300281)) becomes indeterminate. Always be
sure to reset the flag to prevent interrupts or IDMA requests from being generated inadvertently.
FhdMx:HSDMACh.xCause-of-InterruptFlagintheDMAInterruptCauseFlagRegister(Dx/0x300281)
To prevent an interrupt from being generated repeatedly for the same source, be sure to reset the cause-of-inter-
rupt flag before setting up the PSR again or executing the reti instruction.
HSDMA is given higher priority over IDMA (intelligent DMA) and the CPU. However, since HSDMA and
IDMA share the same circuit, HSDMA cannot gain the bus ownership while an IDMA transfer is under way.
Requests for HSDMA invocation that have occurred during an IDMA transfer are kept pending until the IDMA
transfer is completed.
A request for IDMA invocation or an interrupt request that has occurred during a HSDMA transfer are accepted
after completion of the HSDMA transfer.
In dual-address mode, A0RAM (area 0), Specific ROM (area 1), and IVRAM (area 0) cannot be specified as the
source or destination for DMA transfer. While IVRAM (area 3), DST RAM (area 3) and the internal peripheral
I/O registers (area 6) can be used for dual-address transfer.
In single-address mode, A0RAM (area 0), Specific ROM (area 1), area 2, IVRAM (area 0 or area 3), DST RAM
(area 3) and the internal peripheral I/O registers (area 6) cannot be used for DMA transfer.
Single-address mode does not allow data transfer between memory devices. An external logic circuit is required
to perform single-address transfer between memory devices.
Single-address mode does not support the external memory area that is configured for SDRAM.
Be sure to disable the HSDMA before setting the chip in SLEEP mode (executing the slp instruction). HALT
mode can be set even if the HSDMA is enabled.
相關(guān)PDF資料
PDF描述
S1C33T01F0A0100 32-BIT, FLASH, 60 MHz, RISC MICROCONTROLLER, PQFP176
S1C38000B0A0100 32-BIT, RISC MICROCONTROLLER, BGA239
S1C60L02F 4-BIT, MROM, 0.08 MHz, MICROCONTROLLER, PQFP60
S1C60L05F 4-BIT, MROM, 0.08 MHz, MICROCONTROLLER, PQFP60
S1C60L05D 4-BIT, MROM, 0.08 MHz, MICROCONTROLLER, UUC53
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
S1C33L17D00A000 制造商:Seiko Instruments Inc (SII) 功能描述:IC 32BIT MCU 33L17 DIE FORM
S1C33L19 制造商:EPSON 制造商全稱(chēng):EPSON 功能描述:CMOS 32-bit application Specific Controller
S1C33L26 制造商:EPSON 制造商全稱(chēng):EPSON 功能描述:CMOS 32-bit Application Specific Controller
S1C33L27 制造商:EPSON 制造商全稱(chēng):EPSON 功能描述:CMOS 32-bit Application Specific Controller
S1C33S01 制造商:EPSON 制造商全稱(chēng):EPSON 功能描述:32-bit Single Chip Microcontroller
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