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參數(shù)資料
| 型號： | S1C33L17B00E100 |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | MICROCONTROLLER, PBGA180 |
| 封裝： | 12 X 12 MM, 1.2 MM HEIGHT, 0.80 MM PITCH, PLASTIC, BGA-180 |
| 文件頁數(shù)： | 7/1026頁 |
| 文件大小： | 12570K |
| 代理商： | S1C33L17B00E100 |
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aPPendix d Boot
s1C33L17 teChniCaL ManuaL
ePson
aP-d-1
AP
Boot
Appendix D Boot
d.1 Boot Mode
The S1C33L17 supports the five boot modes listed below.
Large-page NAND Flash boot
(Large page: 2048 + 64, 4096 + 128 bytes/page)
Small-page NAND Flash boot
(Small page: 512 + 16, 1024 + 32 bytes/page)
NOR Flash/external ROM boot
(Either 8 bits or 16 bits)
SPI-EEPROM boot
PC RS232C boot
The S1C33L17 boots up in the boot mode that can be selected with the BOOT and #CE10 pin configuration at
initial reset.
Table D.1.1 Setting Boot Mode (PFBGA-180pin or die model)
Boot1 pin
1
0
Boot mode
SPI-EEPROM
PC RS232C
NOR Flash/external ROM
Reserved
Large-page NAND Flash
(> 1024 + 32 bytes/page)
Small-page NAND Flash
(≤ 1024 + 32 bytes/page)
Boot0 pin
1
0
1
0
#Ce10
1 (Input)
0 (Input)
Output
–
1 (Input)
0 (Input)
Boot code start address
0x20010 in the internal
ROM (area 1)
0x2000C in the internal
ROM (area 1)
–
0x20004 in the internal
ROM (area 1)
MBR execution address
0x400 in A0RAM
0x0 in A0RAM
Depending on the
contents in 0xC00000
–
0x0 in A0RAM
Table D.1.2 Setting Boot Mode (TQFP24-144pin model)
Boot1 pin
1
0
Boot mode
NOR Flash/external ROM
Large-page NAND Flash
(> 1024 + 32 bytes/page)
Small-page NAND Flash
(≤ 1024 + 32 bytes/page)
#Ce10
Output
1 (Input)
0 (Input)
Boot code start address
0x2000C in the internal
ROM (area 1)
0x20004 in the internal
ROM (area 1)
MBR execution address
Depending on the
contents in 0xC00000
0x0 in A0RAM
* The TQFP24-144pin model provides the BOOT1 pin only due to the limitation of number of pins (the BOOT0 pin is
pulled down to VSS inside the IC).
Note: For details of the NAND flash boot, refer to the “Supplemental Manual, Card Interface (CARD).”
When the power is turned on or the chip is reset, the boot address is set to 0xC00000 in area 10 (TTBR initial
value) due to the C33 PE Core specification. In the S1C33L17, a 4-word Gate ROM is located at area 10 (address
0xC00000 in the internal area). It contains vectors to jump to the boot sequence (boot code start address) for the
boot mode specified by the pins above.
The boot sequence is programmed in the Specific ROM in area 1.
相關PDF資料 |
PDF描述 |
|---|---|
| S1C33T01F0A0100 | 32-BIT, FLASH, 60 MHz, RISC MICROCONTROLLER, PQFP176 |
| S1C38000B0A0100 | 32-BIT, RISC MICROCONTROLLER, BGA239 |
| S1C60L02F | 4-BIT, MROM, 0.08 MHz, MICROCONTROLLER, PQFP60 |
| S1C60L05F | 4-BIT, MROM, 0.08 MHz, MICROCONTROLLER, PQFP60 |
| S1C60L05D | 4-BIT, MROM, 0.08 MHz, MICROCONTROLLER, UUC53 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| S1C33L17D00A000 | 制造商:Seiko Instruments Inc (SII) 功能描述:IC 32BIT MCU 33L17 DIE FORM |
| S1C33L19 | 制造商:EPSON 制造商全稱:EPSON 功能描述:CMOS 32-bit application Specific Controller |
| S1C33L26 | 制造商:EPSON 制造商全稱:EPSON 功能描述:CMOS 32-bit Application Specific Controller |
| S1C33L27 | 制造商:EPSON 制造商全稱:EPSON 功能描述:CMOS 32-bit Application Specific Controller |
| S1C33S01 | 制造商:EPSON 制造商全稱:EPSON 功能描述:32-bit Single Chip Microcontroller |
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