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參數(shù)資料
| 型號： | S1C33L17B00E100 |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | MICROCONTROLLER, PBGA180 |
| 封裝： | 12 X 12 MM, 1.2 MM HEIGHT, 0.80 MM PITCH, PLASTIC, BGA-180 |
| 文件頁數(shù)： | 498/1026頁 |
| 文件大?。?/td> | 12570K |
| 代理商： | S1C33L17B00E100 |
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V PeRiPheRaL MoDuLes 3 (inteRFaCe): GeneRaL-PuRPose seRiaL inteRFaCe (eFsio)
V-1-24
ePson
s1C33L17 teChniCaL ManuaL
Framing error
If data with a stop bit = 0 is received, the serial interface assumes that the data is out of synchronization and
generates a framing error.
If two stop bits are used, only the first stop bit is checked.
When this error occurs, the framing-error flag FERx (D4/0x300Bx2) is set to 1.
FeRx: Serial I/F Ch.x Framing Error Flag in the Serial I/F Ch.x Status Register (D4/0x300Bx2)
Even when this error occurs, the received data in error is transferred to the receive data buffer and the receive
operation is continued. However, the content of the received data for which a framing error is flagged cannot be
guaranteed, even if no framing error is found in the following data received.
The FERx (D4/0x300Bx2) flag is reset to 0 by writing 0.
overrun error
Even when the receive data buffer is full (4 data have been received), the next (5th) data can be received into
the shift register. If there is no space in the buffer (data has not been read) when the 5th data has been received,
the 5th data in the shift register cannot be transferred to the buffer. If one more (6th) data is transferred to this
serial interface, the shift register (5th data) is overwritten with the 6th data and an overrun error is generated.
When an overrun error is generated, the overrun error flag OERx (D2/0x300Bx2) is set to 1.
oeRx: Serial I/F Ch.x Overrun Error Flag in the Serial I/F Ch.x Status Register (D2/0x300Bx2)
Even when this error occurs, the receive operation is continued.
OERx (D2/0x300Bx2) is reset to 0 by writing 0.
(4) terminating receive operation
When a data receive operation is completed, write 0 to the receive-enable bit RXENx (D6/0x300Bx3) to disable
receive operations. This operation clears (initializes) the receive data buffer (FIFO), therefore, make sure that
there is no data that has not been read in the receive data buffer before setting RXENx (D6/0x300Bx3) to 0.
相關PDF資料 |
PDF描述 |
|---|---|
| S1C33T01F0A0100 | 32-BIT, FLASH, 60 MHz, RISC MICROCONTROLLER, PQFP176 |
| S1C38000B0A0100 | 32-BIT, RISC MICROCONTROLLER, BGA239 |
| S1C60L02F | 4-BIT, MROM, 0.08 MHz, MICROCONTROLLER, PQFP60 |
| S1C60L05F | 4-BIT, MROM, 0.08 MHz, MICROCONTROLLER, PQFP60 |
| S1C60L05D | 4-BIT, MROM, 0.08 MHz, MICROCONTROLLER, UUC53 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| S1C33L17D00A000 | 制造商:Seiko Instruments Inc (SII) 功能描述:IC 32BIT MCU 33L17 DIE FORM |
| S1C33L19 | 制造商:EPSON 制造商全稱:EPSON 功能描述:CMOS 32-bit application Specific Controller |
| S1C33L26 | 制造商:EPSON 制造商全稱:EPSON 功能描述:CMOS 32-bit Application Specific Controller |
| S1C33L27 | 制造商:EPSON 制造商全稱:EPSON 功能描述:CMOS 32-bit Application Specific Controller |
| S1C33S01 | 制造商:EPSON 制造商全稱:EPSON 功能描述:32-bit Single Chip Microcontroller |
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