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參數(shù)資料
| 型號： | S1C33L17B00E100 |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | MICROCONTROLLER, PBGA180 |
| 封裝： | 12 X 12 MM, 1.2 MM HEIGHT, 0.80 MM PITCH, PLASTIC, BGA-180 |
| 文件頁數(shù)： | 729/1026頁 |
| 文件大?。?/td> | 12570K |
| 代理商： | S1C33L17B00E100 |
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ViiiPeRiPheRaLMoDuLes6(LCD):LCDContRoLLeR(LCDC)
Viii-1-14
ePson
s1C33L17teChniCaLManuaL
VDP:Verticaldisplayperiod
Use VDPCNT[9:0] (D[9:0]/0x301A14) to set the vertical display period (= vertical panel resolution).
VDP=VDPCNT[9:0]+1[lines]
*VDPCnt[9:0]:VerticalDisplayPeriod(VDP)SetupBitsintheVerticalDisplayRegister(D[9:0]/0x301A14)
VDPCNT[9:0] (D[9:0]/0x301A14) must be programmed such that the following condition is met:
VT
≥ VDP + 1
VDPs:Verticaldisplayperiodstartposition
Use VDPSCNT[9:0] (D[9:0]/0x301A24) to set the vertical display period start position for the HR-TFT panel.
VDPS=VDPSCNT[9:0][lines]
*VDPsCnt[9:0]:VerticalDisplayPeriodStartPositionSetupBitsintheVerticalDisplayStartPositionRegister
(D[6:0]/0x301A24)
VDPSCNT[9:0] (D[9:0]/0x301A24) must be programmed such that the following condition is met:
VT > VDP + VDPS
VPs:Verticalsyncpulsestartposition
Use FPFST[9:0] (D[25:16]/0x301A2C) to set the vertical sync pulse (FPFRAME or SPS) start position for the
HR-TFT panel.
VPS=FPFST[9:0][lines]=FPFST[9:0]
×HT[Ts]
*FPFst[9:0]:FPFRAMEPulseStartPositionSetupBitsintheFPFRAMEPulseSetupRegister
(D[25:16]/0x301A2C)
VPW:Verticalsyncpulsewidth
Use FPFWD[2:0] (D[2:0]/0x301A2C) to set the vertical sync pulse width for the HR-TFT panel.
VPW=FPFWD[2:0]+1[lines]=(FPFWD[2:0]+1)
×HT[Ts]
*FPFWD[2:0]:FPFRAMEPulseWidthSetupBitsintheFPFRAMEPulseSetupRegister(D[2:0]/0x301A2C)
Verticalsyncpulsepolarity
Use FPFPOL (D7/0x301A2C) to set the vertical sync pulse polarity for the HR-TFT panel.
FPFPOL=1:ActiveHigh
FPFPOL=0:Activelow(default)
*FPFPoL:FPFRAMEPulsePolaritySetupBitintheFPFRAMEPulseSetupRegister(D7/0x301A2C)
Verticalsyncpulseoffset
The vertical sync pulse position and width that are basically set in line units can be adjusted in pixel clock units.
FPLINE/LP
FPFRME/SPS
(withoutoffset)
FPFRME/SPS
(withoffset)
VPS
VPW
VPS'
(FPLINE/FPFRAMEpulsepolarity:Activelow)
VPW'
FPFRAMEpulse
startoffset
FPFRAMEpulse
stopoffset
FigureVIII.1.5.3.3VerticalSyncPulseOffset
Use FPFSTO[9:0] (D[9:0]/0x301A30) and FPFSTPO[9:0] (D[25:16]/0x301A30) to adjust the vertical sync
pulse start and stop positions.
VPS’=FPFST[9:0]
×HT+FPFSTO[9:0][Ts]
VPW’=(FPFWD[2:0]+1)
×HT-FPFSTO[9:0]+FPFSTPO[9:0][Ts]
*FPFsto[9:0]:FPFRAMEPulseStartOffsetBitsintheFPFRAMEPulseOffsetRegister(D[9:0]/0x301A30)
*FPFstPo[9:0]:FPFRAMEPulseStopOffsetBitsintheFPFRAMEPulseOffsetRegister(D[25:16]/0x301A30)
相關PDF資料 |
PDF描述 |
|---|---|
| S1C33T01F0A0100 | 32-BIT, FLASH, 60 MHz, RISC MICROCONTROLLER, PQFP176 |
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| S1C60L02F | 4-BIT, MROM, 0.08 MHz, MICROCONTROLLER, PQFP60 |
| S1C60L05F | 4-BIT, MROM, 0.08 MHz, MICROCONTROLLER, PQFP60 |
| S1C60L05D | 4-BIT, MROM, 0.08 MHz, MICROCONTROLLER, UUC53 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
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| S1C33L19 | 制造商:EPSON 制造商全稱:EPSON 功能描述:CMOS 32-bit application Specific Controller |
| S1C33L26 | 制造商:EPSON 制造商全稱:EPSON 功能描述:CMOS 32-bit Application Specific Controller |
| S1C33L27 | 制造商:EPSON 制造商全稱:EPSON 功能描述:CMOS 32-bit Application Specific Controller |
| S1C33S01 | 制造商:EPSON 制造商全稱:EPSON 功能描述:32-bit Single Chip Microcontroller |
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