參數(shù)資料
型號(hào)： G2CORERMAD
英文描述： Errata to G2 PowerPC Core Reference Manual Rev. 0
中文描述： 勘誤表的G2 PowerPC的核心參考手冊(cè)牧師0
文件頁(yè)數(shù)： 97/506頁(yè)
文件大?。?/td> 6720K
代理商： G2CORERMAD
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MOTOROLA
Chapter 2. Register Model
2-13
Register Set
Table 2-6 shows how HID0[BCLK], HID0[ECLK], and core_hreset are used to configure
core_clk_out. See Section 8.3.15.2, “Test Clock Output (core_clk_out),” for more
information.
21
DCFI
Data cache flash invalidate
0 The data cache is not invalidated. The bit is cleared when the invalidation operation begins
(usually the next cycle after the write operation to the register). The data cache must be enabled
for the invalidation to occur.
1 An invalidate operation is issued that marks the state of each data cache block as invalid
without writing back modified cache blocks to memory. Cache access is blocked during this
time. Bus accesses to the cache are signaled as a miss during invalidate-all operations. Setting
DCFI clears all the valid bits of the blocks and the PLRU bits to point to way L0 of each set.
For the G2 core, the proper use of the ICFI and DCFI bits is to set and clear them with two
consecutive
mtspr
operations.
22–23
—
Reserved, should be cleared.
24
IFEM
Enable M bit on 60x bus for instruction fetches
0 M bit not reflected on bus for instruction fetches. Instruction fetches are treated as nonglobal
on the bus.
1 Instruction fetches reflect the M bit from the WIM settings
25–26
—
Reserved, should be cleared.
27
FBIOB
Force branch indirect on bus
0 Register indirect branch targets are fetched normally
1 Forces register indirect branch targets to be fetched externally
28
ABE
Address broadcast enable. Controls whether certain address-only operations (such as cache
operations) are broadcast on the 60x bus.
0 Address-only operations affect only local caches and are not broadcast
1 Address-only operations are broadcast on the 60x bus
Affected instructions are
dcbi
,
dcbf
, and
dcbst
. Note that these cache control instruction
broadcasts are not snooped by the G2 core. Refer to Section 4.3.3, “Data Cache Control,” for
more information.
29–30
—
Reserved, should be cleared.
31
NOOPTI
No-op the data cache touch instructions
0 The
dcbt
and
dcbtst
instructions are enabled
1 The
dcbt
and
dcbtst
instructions are no-oped globally
1
See Chapter 10, “Power Management.”
2
See Chapter 4, “Instruction and Data Cache Operation.”
Table 2-5. HID0 Bit Functions (continued)
Bits
Name
Function
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
相關(guān)PDF資料
PDF描述
G2RL-1
G2RL-14
G2RL-14-CF
G2RL-14-CFDC12
G2RL-14DC12
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
G2D 制造商:VISHAY 制造商全稱:Vishay Siliconix 功能描述:GLASS PASSIVATED JUNCTION RECTIFIER
G2D/4 功能描述:整流器 200 Volt 2.0 Amp RoHS:否 制造商:Vishay Semiconductors 產(chǎn)品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復(fù)時(shí)間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel
G2D01D01024.0 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY
G2D01D01060.0 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY
G2D120-AA04-01 制造商:ebm-papst Inc 功能描述:G2D120-AA04-01
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