參數(shù)資料
型號(hào)： G2CORERMAD
英文描述： Errata to G2 PowerPC Core Reference Manual Rev. 0
中文描述： 勘誤表的G2 PowerPC的核心參考手冊(cè)牧師0
文件頁(yè)數(shù)： 357/506頁(yè)
文件大?。?/td> 6720K
代理商： G2CORERMAD
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MOTOROLA
Chapter 8. Signal Descriptions
8-45
Signal Descriptions
8.3.10.3.5 True Little-Endian Mode (core_tle)—Input
Following are the state meaning and timing comments for the core_tle input on the G2_LE
core.
State Meaning
Asserted—Causes MSR[LE], MSR[ILE], and HID2[LET] to be
initialized to ones at core_hreset. See Table 2-8 for more information
on the operation of the core when HID2[LET] = 1.
Negated—Causes MSR[LE], MSR[ILE], and HID2[LET] to be
initialized to zeros at core_hreset.
Timing Comments
Assertion/Negation—This signal is sampled during assertion of
core_hreset and must be stable five cycles before the negation of
core_hreset as defined in the hardware specification.
8.3.10.3.6 System Version Register (core_svr[0:31])—Input
Following are the state meaning for the core_svr[0:31] inputs on the G2_LE core.
State Meaning
Asserted/Negated—Identify the system version and revision level of
the system on a chip (SOC) level of integration. The value of these
signals is loaded into the system version register (SVR) at the
negation of core_hreset. For further detailed description of the
associated register, see Section 2.1.2.12, “System Version Register
(SVR)—G2_LE Only.”
Timing Comments
Assertion/Negation—These signals are sampled during assertion of
core_hreset and must be stable five cycles before the negation of
core_hreset as defined in the hardware specification.
8.3.11 Processor Status Signals
Processor status signals indicate the state of the processor. This includes the memory
reservation, machine quiesce control, time base enable, and core_tlbisync signals.
8.3.11.1 Quiescent Acknowledge (core_qack)—Input
Following are the state meaning and timing comments for the core_qack input.
State Meaning
Asserted—Indicates that all bus activity that requires snooping has
terminated or paused, and that the core may enter the quiescent (or
low-power) state.
Negated—Indicates that the core may not enter a quiescent state and
must continue snooping the bus.
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
相關(guān)PDF資料
PDF描述
G2RL-1
G2RL-14
G2RL-14-CF
G2RL-14-CFDC12
G2RL-14DC12
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
G2D 制造商:VISHAY 制造商全稱(chēng):Vishay Siliconix 功能描述:GLASS PASSIVATED JUNCTION RECTIFIER
G2D/4 功能描述:整流器 200 Volt 2.0 Amp RoHS:否 制造商:Vishay Semiconductors 產(chǎn)品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復(fù)時(shí)間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel
G2D01D01024.0 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY
G2D01D01060.0 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY
G2D120-AA04-01 制造商:ebm-papst Inc 功能描述:G2D120-AA04-01
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