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參數(shù)資料
| 型號： | G2CORERMAD |
| 英文描述： | Errata to G2 PowerPC Core Reference Manual Rev. 0 |
| 中文描述： | 勘誤表的G2 PowerPC的核心參考手冊牧師0 |
| 文件頁數(shù)： | 491/506頁 |
| 文件大?。?/td> | 6720K |
| 代理商： | G2CORERMAD |
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MOTOROLA
Glossary of Terms and Abbreviations
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Glossary-15
Transaction.
A complete exchange between two bus devices. A transaction
is typically comprised of an address tenure and one or more data
tenures, which may overlap or occur separately from the address
tenure. A transaction may be minimally comprised of an address
tenure only.
Transfer termination.
Signal that refers to both signals that acknowledge
the transfer of individual beats (of both single-beat transfer and
individual beats of a burst transfer) and to signals that mark the end
of the tenure.
U
UISA (user instruction set architecture).
The level of the architecture to
which user-level software should conform. The UISA defines the
base user-level instruction set, user-level registers, data types,
floating-point memory conventions and exception model as seen by
user programs, and the memory and programming models.
Underflow.
A condition that occurs during arithmetic operations when the
result cannot be represented accurately in the destination register.
For example, underflow can happen if two floating-point fractions
are multiplied and the result requires a smaller
exponent
and/or
mantissa
than the single-precision format can provide. In other
words, the result is too small to be represented accurately.
User mode.
The operating state of a processor used typically by application
software. In user mode, software can access only certain control
registers and can access only user memory space. No privileged
operations can be performed. Also referred to as problem state.
V
VEA (virtual environment architecture).
The level of the
architecture
that
describes the memory model for an environment in which multiple
devices can access memory, defines aspects of the cache model,
defines cache control instructions, and defines the time-base facility
from a user-level perspective.
Implementations
that conform to the
PowerPC VEA also adhere to the UISA, but may not necessarily
adhere to the OEA.
Virtual address.
An intermediate address used in the translation of an
effective address
to a physical address.
Virtual memory.
The address space created using the memory management
facilities of the processor. Program access to
virtual
memory
is
possible only when it coincides with
physical memory
.
F
Freescale Semiconductor, Inc.
n
.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| G2RL-1 | |
| G2RL-14 | |
| G2RL-14-CF | |
| G2RL-14-CFDC12 | |
| G2RL-14DC12 | |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| G2D | 制造商:VISHAY 制造商全稱:Vishay Siliconix 功能描述:GLASS PASSIVATED JUNCTION RECTIFIER |
| G2D/4 | 功能描述:整流器 200 Volt 2.0 Amp RoHS:否 制造商:Vishay Semiconductors 產(chǎn)品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復時間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel |
| G2D01D01024.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D01D01060.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D120-AA04-01 | 制造商:ebm-papst Inc 功能描述:G2D120-AA04-01 |
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