參數(shù)資料
型號(hào)： G2CORERMAD
英文描述： Errata to G2 PowerPC Core Reference Manual Rev. 0
中文描述： 勘誤表的G2 PowerPC的核心參考手冊(cè)牧師0
文件頁(yè)數(shù)： 360/506頁(yè)
文件大?。?/td> 6720K
代理商： G2CORERMAD
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8-48
G2 PowerPC Core Reference Manual
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MOTOROLA
Signal Descriptions
Figure 8-4. IEEE 1149.1-Compliant Boundary Scan Interface
These signals are not used during normal operation. core_tms, core_tdi, and core_trst have
internal pull-up resistors provided; core_tck does not. For normal operation, core_tms and
core_tdi may be left unconnected, and core_tck must be set high or low. The core_trst signal
must be asserted sometime during power-up for JTAG logic initialization. Note that if
core_trst is tied low, unnecessary power is consumed.
8.3.12.1 JTAG Test Clock (core_tck)—Input
The JTAG test clock (core_tck) signal is an input on the G2 core. Following are the state
meaning and timing comments for the core_tck input signal.
State Meaning
Asserted/Negated—This input should be driven by a free-running
clock signal. Input signals to the test access port are clocked in on the
rising edge of core_tck. Changes to the test access port output signals
occur on the falling edge of core_tck. The test logic allows core_tck
to be stopped.
Timing Comments
Assertion/Negation—core_tck should not be used during normal
operation and always must be set to either a high or low logic state.
8.3.12.2 JTAG Test Data Input (core_tdi)—Input
Following is the state meaning and timing comments for the core_tdi input signal.
State Meaning
Asserted/Negated—The value presented on this signal on the rising
edge of core_tck is clocked into the selected JTAG test instruction or
data register.
Timing Comments
Assertion/Negation—core_tdi should not be used during normal
operation and always must be set to a high or low logic state. Note
that this input contains an internal pull-up resistor to ensure that an
unterminated input appears as a high signal level to the test logic.
core_tdi
(Test Data Input)
core_tms
(Test Mode Select)
core_tck
(Test Clock Input)
core_TDO
(Test Data Output)
core_trst
(Test Reset)
F
Freescale Semiconductor, Inc.
n
.
相關(guān)PDF資料
PDF描述
G2RL-1
G2RL-14
G2RL-14-CF
G2RL-14-CFDC12
G2RL-14DC12
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
G2D 制造商:VISHAY 制造商全稱(chēng):Vishay Siliconix 功能描述:GLASS PASSIVATED JUNCTION RECTIFIER
G2D/4 功能描述:整流器 200 Volt 2.0 Amp RoHS:否 制造商:Vishay Semiconductors 產(chǎn)品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復(fù)時(shí)間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel
G2D01D01024.0 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY
G2D01D01060.0 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY
G2D120-AA04-01 制造商:ebm-papst Inc 功能描述:G2D120-AA04-01
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