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參數(shù)資料
| 型號： | G2CORERMAD |
| 英文描述： | Errata to G2 PowerPC Core Reference Manual Rev. 0 |
| 中文描述： | 勘誤表的G2 PowerPC的核心參考手冊牧師0 |
| 文件頁數(shù)： | 426/506頁 |
| 文件大?。?/td> | 6720K |
| 代理商： | G2CORERMAD |
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11-4
G2 PowerPC Core Reference Manual
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MOTOROLA
Expanded Debugging Facilities in Breakpoint Registers
IABR[BE] and IABR2[BE] enable and control instruction address breakpoint, and IBCR
controls match conditions (see Section 2.1.2.14.1, “Instruction Address Breakpoint Control
Registers (IBCR)—G2_LE Only,” for more details). DABR[29–31] and DABR2[29–31]
enable and control data address breakpoint and DBCR controls match conditions.
When MSR[SE] (single-step trace enable) is set, the processor core generates a trace
exception (0x00D00) upon the successful completion of the next instruction. When the
MSR[BE] (branch trace enable) is set, the processor core generates a trace exception
(0x00D00) upon the successful completion of a branch instruction.
11.2 Expanded Debugging Facilities in Breakpoint
Registers
Breakpoint, single-step, and branch trace enable, address and combinational matching are
additional debugging facilities provided by the breakpoint registers (DABR, DABR2,
IABR, and IABR2).
11.2.1 Breakpoint Enabled
When an instruction address breakpoint is set, and a condition is matched, an instruction
address breakpoint exception (0x01300) occurs along with executing the matched
instruction. The instruction retires after it has returned from the exception. When a data and
a condition are matched, a DSI exception (0x00300) occurs along with executing the
matched instruction. The instruction retires after it has returned from the exception and has
updated all memory or registers.
11.2.2 Single-Step Enabled
Single-stepping can be a very useful tool in software debugging. This debug feature
executes one instruction before it takes a trace exception. In trace exception, the result is
being examined after that one instruction has executed.
When MSR[SE] (single-step trace enable) is set, the processor generates a trace exception
(0x00D00) upon the successful completion of the next instruction. A trace exception is not
taken for an
isync
,
sync
,
rfi
,
rfci
,
or
mtmsr
instructions. If softstop or hardstop is enabled,
and MSR[SE]
bit is set, the machine with stop before the present instruction is retired and
not take a trace exception.
MSR can be set by using
mtmsr
or by setting the SRR0 bit corresponding to MSR[SE]
before returning from an interrupt. If the SRR0 is set after returning from the interrupt,
single-step is enabled by executing one instruction along with taking the trace exception.
A typical software debugging procedure is to set a instruction address breakpoint at the
instruction address to be single stepped. When the IABR exception is taken, the exception
F
Freescale Semiconductor, Inc.
n
.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| G2RL-1 | |
| G2RL-14 | |
| G2RL-14-CF | |
| G2RL-14-CFDC12 | |
| G2RL-14DC12 | |
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參數(shù)描述 |
|---|---|
| G2D | 制造商:VISHAY 制造商全稱:Vishay Siliconix 功能描述:GLASS PASSIVATED JUNCTION RECTIFIER |
| G2D/4 | 功能描述:整流器 200 Volt 2.0 Amp RoHS:否 制造商:Vishay Semiconductors 產(chǎn)品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復(fù)時間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel |
| G2D01D01024.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D01D01060.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D120-AA04-01 | 制造商:ebm-papst Inc 功能描述:G2D120-AA04-01 |
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