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參數(shù)資料
| 型號： | G2CORERMAD |
| 英文描述： | Errata to G2 PowerPC Core Reference Manual Rev. 0 |
| 中文描述： | 勘誤表的G2 PowerPC的核心參考手冊牧師0 |
| 文件頁數(shù)： | 34/506頁 |
| 文件大小： | 6720K |
| 代理商： | G2CORERMAD |
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xxxiv
G2 PowerPC Core Reference Manual
For More Information On This Product,
Go to: www.freescale.com
MOTOROLA
Suggested Reading
Chapter 9, “Core Interface Operation,” describes signal timings for various
operations. It also provides a detailed description of the 60x bus interface, the
multiple bus master capability, and the memory coherency features of the G2 core.
Chapter 10, “Power Management,” provides information about the power saving
modes for the G2 core.
Chapter 11, “Debug Features,” provides information about the debug features of the
G2_LE core. This chapter also describes trace facility debug features for both the G2
and G2_LE cores.
Appendix A, “PowerPC Instruction Set Listings,” lists all the PowerPC instructions
while indicating those instructions that are not implemented by the G2 and G2_LE
cores; it also includes the instructions that are specific to the G2 and G2_LE cores.
Instructions are grouped according to mnemonic, opcode, function, and form. Also
included is a quick referrence table that contains general information, such as the
architecture level, privilege level, and form, and indicates if the instruction is 64-bit
and optional.
Appendix B, “Revision History,” lists the major differences between Revision 1 and
Revision 2 of the
G2 Core Reference Manual
.
This reference manual also includes a glossary and an index.
Suggested Reading
This section lists additional reading that provides background for the information in this
reference manual, as well as general information about the PowerPC architecture.
General Information
The following documentation, available through Morgan-Kaufmann Publishers, 340 Pine
Street, Sixth Floor, San Francisco, CA, provides useful information about the PowerPC
architecture and computer architecture in general:
The PowerPC Architecture: A Specification for a New Family of RISC Processors
,
Second Edition, by International Business Machines, Inc.
Updates to the architecture specification are accessible via the world-wide web at
http://www.austin.ibm.com/tech/ppc-chg.html.
PowerPC Microprocessor Common Hardware Reference Platform: A System
Architecture
, by Apple Computer, Inc., International Business Machines, Inc., and
Motorola, Inc.
Computer Architecture: A Quantitative Approach
, Second Edition,
John L. Hennessy and David A. Patterson.
Computer Organization and Design: The Hardware/Software Interface
, Second
Edition, David A. Patterson and John L. Hennessy.
F
Freescale Semiconductor, Inc.
n
.
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PDF描述 |
|---|---|
| G2RL-1 | |
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參數(shù)描述 |
|---|---|
| G2D | 制造商:VISHAY 制造商全稱:Vishay Siliconix 功能描述:GLASS PASSIVATED JUNCTION RECTIFIER |
| G2D/4 | 功能描述:整流器 200 Volt 2.0 Amp RoHS:否 制造商:Vishay Semiconductors 產(chǎn)品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復(fù)時間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel |
| G2D01D01024.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D01D01060.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D120-AA04-01 | 制造商:ebm-papst Inc 功能描述:G2D120-AA04-01 |
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