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參數(shù)資料
| 型號： | G2CORERMAD |
| 英文描述： | Errata to G2 PowerPC Core Reference Manual Rev. 0 |
| 中文描述： | 勘誤表的G2 PowerPC的核心參考手冊牧師0 |
| 文件頁數(shù)： | 201/506頁 |
| 文件大?。?/td> | 6720K |
| 代理商： | G2CORERMAD |
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MOTOROLA
Chapter 5. Exceptions
5-9
Exception Processing
completed. The exception is then taken without completing the exception-causing
instruction. If any other exception condition is created in completing these previous
instructions in the machine, that exception takes priority over the pending
instruction dispatch/execution exception, which will then be forgotten.
Post-instruction execution—(trace). This type of exception is generated following
execution and completion of an instruction while a trace mode is enabled. If
executing the instruction produces conditions for another type of interrupt, that
exception is taken and the post-instruction execution exception is forgotten for that
instruction.
5.2
Exception Processing
When an exception is taken, the processor uses the save/restore registers, SRR0 and SRR1,
to save the contents of the machine state register for user-level mode and to identify where
instruction execution should resume after the exception is handled.
5.2.1
Exception Processing Registers
The G2 core implements the SRR0 and SRR1 registers that are used for saving processor
state on an exception. The G2_LE core also uses these registers; additionally, the G2_LE
core implements CSRR0 and CSRR1 to specifically save state for critical interrupt
exceptions.
5.2.1.1
SRR0 and SRR1 Bit Settings
When an exception occurs, SRR0 is set to point to the instruction at which instruction
processing should resume when the exception handler returns control to the interrupted
process. All instructions in the program flow preceding this one will have completed and
no subsequent instruction will have completed. This may be the address of the instruction
that caused the exception or the next one (as in the case of a system call exception). The
instruction addressed can be determined from the exception type and status bits. This
address is used to resume instruction processing in the interrupted process, typically when
an
rfi
instruction is executed. The SRR0 register is shown in Figure 5-1
.
Figure 5-1. Machine Status Save/Restore Register 0 (SSR0)
The save/restore register 1 (SRR1) is used to save machine status (the contents of the MSR)
on exceptions and to restore those values when
rfi
is executed. SRR1 is shown in
Figure 5-2.
SRR0 (holds EA for resuming program execution)
0
31
F
Freescale Semiconductor, Inc.
Go to: www.freescale.com
n
.
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PDF描述 |
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| G2RL-1 | |
| G2RL-14 | |
| G2RL-14-CF | |
| G2RL-14-CFDC12 | |
| G2RL-14DC12 | |
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參數(shù)描述 |
|---|---|
| G2D | 制造商:VISHAY 制造商全稱:Vishay Siliconix 功能描述:GLASS PASSIVATED JUNCTION RECTIFIER |
| G2D/4 | 功能描述:整流器 200 Volt 2.0 Amp RoHS:否 制造商:Vishay Semiconductors 產(chǎn)品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復(fù)時間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel |
| G2D01D01024.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D01D01060.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D120-AA04-01 | 制造商:ebm-papst Inc 功能描述:G2D120-AA04-01 |
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