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參數(shù)資料
| 型號： | G2CORERMAD |
| 英文描述： | Errata to G2 PowerPC Core Reference Manual Rev. 0 |
| 中文描述： | 勘誤表的G2 PowerPC的核心參考手冊牧師0 |
| 文件頁數(shù)： | 324/506頁 |
| 文件大?。?/td> | 6720K |
| 代理商： | G2CORERMAD |
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8-12
G2 PowerPC Core Reference Manual
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MOTOROLA
Signal Descriptions
State Meaning
Asserted—Indicates that the G2 core may, with the proper
qualification, assume mastership of the 60x address bus. See
Section 9.3.1, “Address Bus Arbitration.”
Negated—Indicates that the core is not the next potential address bus
master.
Assertion—May occur at any time to indicate the core is free to use
the address bus. After the core assumes bus mastership, it does not
check for a qualified bus grant again until the cycle during which the
address bus tenure is completed (assuming it has another transaction
to run). The core does not accept a core_bg in the cycles between the
assertion of either core_ts_in or core_ts_out and core_aack.
Negation—May occur anytime to indicate the core cannot use the
bus. The core may still assume bus mastership on the bus clock cycle
of the negation of core_bg because during the previous cycle
core_bg indicated to the core that it was free to take mastership (if
qualified).
Timing Comments
8.3.1.3
Address Bus Busy
There is both an address bus busy input and address bus busy output signal on the G2 core.
The core also implements address bus busy output enable and address bus busy
high-impedance enable signals.
8.3.1.3.1
Address Bus Busy In (core_abb_in)
Following are the state meaning and timing comments for core_abb_in.
State Meaning
Asserted—Indicates that the address bus is in use. This condition
effectively blocks the core from assuming address bus ownership,
regardless of the core_bg input; see Section 9.3.1, “Address Bus
Arbitration.”
Negated—Indicates that the address bus is not owned by another bus
master and that it is available to the core when accompanied by a
qualified bus grant.
Timing Comments
Assertion—May occur when the core must be prevented from using
the address bus (and the processor is not currently asserting
core_abb_out).
Negation—May occur whenever the core can use the address bus.
F
Freescale Semiconductor, Inc.
n
.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| G2RL-1 | |
| G2RL-14 | |
| G2RL-14-CF | |
| G2RL-14-CFDC12 | |
| G2RL-14DC12 | |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| G2D | 制造商:VISHAY 制造商全稱:Vishay Siliconix 功能描述:GLASS PASSIVATED JUNCTION RECTIFIER |
| G2D/4 | 功能描述:整流器 200 Volt 2.0 Amp RoHS:否 制造商:Vishay Semiconductors 產(chǎn)品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復(fù)時間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel |
| G2D01D01024.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D01D01060.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D120-AA04-01 | 制造商:ebm-papst Inc 功能描述:G2D120-AA04-01 |
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