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參數(shù)資料
| 型號： | G2CORERMAD |
| 英文描述： | Errata to G2 PowerPC Core Reference Manual Rev. 0 |
| 中文描述： | 勘誤表的G2 PowerPC的核心參考手冊牧師0 |
| 文件頁數(shù)： | 218/506頁 |
| 文件大?。?/td> | 6720K |
| 代理商： | G2CORERMAD |
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5-26
G2 PowerPC Core Reference Manual
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MOTOROLA
Exception Definitions
The execution of any load/store instruction to a direct-store segment (SR[T] = 1)
A data access crosses from a memory segment (SR[T] = 0) into a direct-store
segment (SR[T] = 1)
Finally, the G2_LE core causes a DSI exception when either the DABR or DABR2 is
enabled and the address of an access matches with the value in the CEA field and the
breakpoint is enabled for the type of access (read or write) in DABR/DABR2. See
Chapter 11, “Debug Features,” and Section 2.1.2.15, “Data Address Breakpoint Register
(DABR and DABR2)—G2_LE Only,” for more information.
DSI exceptions can be generated by load/store instructions and cache control instructions
(
dcbi
,
dcbz
,
dcbst
, and
dcbf
). Note that the
dcbi
instruction should never be used on the
G2 core.
The G2 core supports the crossing of page boundaries. However, if the second page has a
translation error or protection violation associated with it, the G2 core takes the DSI
exception in the middle of the instruction. In this case, the data address register (DAR)
always points to a byte address in the first word of the offending page.
If an
stwcx.
instruction has an effective address for which a normal store operation would
cause a DSI exception, the G2 core takes the DSI exception without checking for the
reservation.
If the XER indicates that the byte count for an
lswi
or
stswi
instruction is zero, a DSI
exception does not occur, regardless of the effective address.
The condition that caused the exception is defined in the DSISR. These conditions also use
the data address register (DAR) as shown in Table 5-14.
When a DSI exception is taken, instruction execution for the handler begins at offset
0x00300 from the physical base address indicated by MSR[IP].
The architecture permits certain instructions to be partially executed when they cause a DSI
exception. These are as follows:
Load multiple or load string instructions—some registers in the range of registers to
be loaded may have been loaded.
Store multiple or store string instructions—some bytes of memory in the range
addressed may have been updated.
In these cases, the number of registers and amount of memory altered are instruction- and
boundary-dependent. However, memory protection is not violated. Furthermore, if some of
the data accessed is in direct-store space (SR[T] = 1) and the instruction is not supported
for direct-store accesses, the locations in direct-store space are not accessed.
For update forms, the update register (
r
A) is not altered.
F
Freescale Semiconductor, Inc.
n
.
相關PDF資料 |
PDF描述 |
|---|---|
| G2RL-1 | |
| G2RL-14 | |
| G2RL-14-CF | |
| G2RL-14-CFDC12 | |
| G2RL-14DC12 | |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| G2D | 制造商:VISHAY 制造商全稱:Vishay Siliconix 功能描述:GLASS PASSIVATED JUNCTION RECTIFIER |
| G2D/4 | 功能描述:整流器 200 Volt 2.0 Amp RoHS:否 制造商:Vishay Semiconductors 產(chǎn)品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復時間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel |
| G2D01D01024.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D01D01060.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D120-AA04-01 | 制造商:ebm-papst Inc 功能描述:G2D120-AA04-01 |
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