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參數(shù)資料
| 型號(hào)： | G2CORERMAD |
| 英文描述： | Errata to G2 PowerPC Core Reference Manual Rev. 0 |
| 中文描述： | 勘誤表的G2 PowerPC的核心參考手冊(cè)牧師0 |
| 文件頁數(shù)： | 231/506頁 |
| 文件大?。?/td> | 6720K |
| 代理商： | G2CORERMAD |
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MOTOROLA
Chapter 5. Exceptions
5-39
Exception Definitions
Section 2.1.2.14, “Instruction Address Breakpoint Registers (IABR and IABR2),” and
Chapter 11, “Debug Features,” provide more information about the instruction breakpoint
facility.
5.5.17 System Management Interrupt (0x01400)
The system management interrupt behaves like an external interrupt except for the signal
asserted and the vector taken. A system management interrupt is signaled to the G2 core by
the assertion of the core_smi signal. The interrupt may not be recognized if a higher priority
exception occurs simultaneously or if MSR[EE] is cleared when core_smi is asserted. Note
that core_smi takes priority over core_int if they are recognized simultaneously.
After the core_smi is detected (and provided that MSR[EE] is set), the G2 core generates a
recoverable halt to instruction completion. The G2 core requires the next instruction in
program order to complete or except, block completion of any following instructions, and
allow the completed store queue to drain (see Section 7.1, “Terminology and Conventions,”
for the definition). If any higher priority exceptions are encountered in this process, they
are taken first and the system management interrupt is delayed until a recoverable halt is
achieved. At this time the G2 core saves state information and takes the system
management interrupt.
The register settings for the external interrupt exception are shown in Table 5-23.
Table 5-22. Breakpoint Action for Multiple Modes Enabled for the Same Address
IABR[IE]
MSR[BE]
MSR[SE]
First Action
Next Action
Comments
1
1
0
Instruction
address
breakpoint
Trace (branch) Enabling both modes is useful only if both
trace and address breakpoint interrupts are
needed.
1
0
1
Instruction
address
breakpoint
Trace
(single-step)
Enabling both modes is useful only if different
breakpoint actions are required.
0
1
1
Trace (branch) None
The action for branch trace and single-step
trace is the same. Enabling both trace modes
is redundant except for hard stop on
branches.
1
1
1
Instruction
address
breakpoint
Trace
Enabling all modes is redundant. This entry is
for clarification only.
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| G2RL-1 | |
| G2RL-14 | |
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| G2RL-14DC12 | |
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參數(shù)描述 |
|---|---|
| G2D | 制造商:VISHAY 制造商全稱:Vishay Siliconix 功能描述:GLASS PASSIVATED JUNCTION RECTIFIER |
| G2D/4 | 功能描述:整流器 200 Volt 2.0 Amp RoHS:否 制造商:Vishay Semiconductors 產(chǎn)品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復(fù)時(shí)間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel |
| G2D01D01024.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D01D01060.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D120-AA04-01 | 制造商:ebm-papst Inc 功能描述:G2D120-AA04-01 |
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