參數(shù)資料
型號(hào)： G2CORERMAD
英文描述： Errata to G2 PowerPC Core Reference Manual Rev. 0
中文描述： 勘誤表的G2 PowerPC的核心參考手冊(cè)牧師0
文件頁(yè)數(shù)： 250/506頁(yè)
文件大?。?/td> 6720K
代理商： G2CORERMAD
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6-18
G2 PowerPC Core Reference Manual
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MOTOROLA
MMU Features
Table 6-6 summarizes the registers that the operating system uses to program the G2 core
MMUs. These registers are accessible to supervisor-level software only. These registers are
described in Chapter 2, “Register Set,” in the
Programming Environments Manual.
For G2
core-specific registers, see Chapter 2, “Register Model,” of this book.
tlbli
(implementation
-specific)
Load Instruction TLB Entry
Loads the contents of the ICMP and RPA registers into the ITLB.
tlbld
(implementation
-specific)
Load Data TLB Entry
Loads the contents of the DCMP and RPA registers into the DTLB.
1
These instructions are defined by the PowerPC architecture, but are optional.
Table 6-6. MMU Registers
Register
Description
Segment registers
(SR0–SR15)
The sixteen 32-bit segment registers are present only in 32-bit implementations of the
PowerPC architecture. The fields in the segment register are interpreted differently
depending on the value of bit 0. The segment registers are accessed by the
mtsr
,
mtsrin
,
mfsr
, and
mfsrin
instructions.
BAT registers
G2 core: (IBAT0U–IBAT3U,
IBAT0L–IBAT3L,
DBAT0U–DBAT3U, and
DBAT0L–DBAT3L)
G2_LE core:
(IBAT0U–IBAT7U,
IBAT0L–IBAT7L,
DBAT0U–DBAT7U, and
DBAT0L–DBAT7L)
The G2 core has 16 BAT registers, organized as 4 pairs of instruction BAT registers
(IBAT0U–IBAT3U paired with IBAT0L–IBAT3L) and 4 pairs of data BAT registers
(DBAT0U–DBAT3U paired with DBAT0L–DBAT3L).
The G2_LE core has 32 BAT registers, organized as 8 pairs of instruction BAT registers
(IBAT0U–IBAT7U paired with IBAT0L–IBAT7L) and 8 pairs of data BAT registers
(DBAT0U–DBAT7U paired with DBAT0L–DBAT7L).
The BAT registers are defined as 32-bit registers in 32-bit implementations. These are
special-purpose registers that are accessed by the
mtspr
and
mfspr
instructions,
regardless of the setting of HID2[13].
SDR1
The SDR1 register specifies the variable used in accessing the page tables in memory.
SDR1 is defined as a 32-bit register for 32-bit implementations. This is a
special-purpose register that is accessed by the
mtspr
and
mfspr
instructions.
Instruction TLB miss address
and data TLB miss address
registers (IMISS and DMISS)
When a TLB miss exception occurs, the IMISS or DMISS register contains the 32-bit
effective address of the instruction or data access, respectively, that caused the miss.
Note that the G2 core always loads a big-endian address into the DMISS register.
These registers are implementation-specific.
Primary and secondary hash
address registers (HASH1
and HASH2)
The HASH1 and HASH2 registers contain the primary and secondary PTEG addresses
that correspond to the address causing a TLB miss. These PTEG addresses are
automatically derived by the core by performing the primary and secondary hashing
function on the contents of IMISS or DMISS, for an ITLB or DTLB miss exception,
respectively.
These registers are implementation-specific.
Table 6-5. Instruction Summary—MMU Control (continued)
Instruction
Description
F
Freescale Semiconductor, Inc.
n
.
相關(guān)PDF資料
PDF描述
G2RL-1
G2RL-14
G2RL-14-CF
G2RL-14-CFDC12
G2RL-14DC12
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
G2D 制造商:VISHAY 制造商全稱:Vishay Siliconix 功能描述:GLASS PASSIVATED JUNCTION RECTIFIER
G2D/4 功能描述:整流器 200 Volt 2.0 Amp RoHS:否 制造商:Vishay Semiconductors 產(chǎn)品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復(fù)時(shí)間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel
G2D01D01024.0 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY
G2D01D01060.0 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY
G2D120-AA04-01 制造商:ebm-papst Inc 功能描述:G2D120-AA04-01
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