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參數(shù)資料
| 型號： | G2CORERMAD |
| 英文描述： | Errata to G2 PowerPC Core Reference Manual Rev. 0 |
| 中文描述： | 勘誤表的G2 PowerPC的核心參考手冊牧師0 |
| 文件頁數(shù)： | 145/506頁 |
| 文件大?。?/td> | 6720K |
| 代理商： | G2CORERMAD |
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MOTOROLA
Chapter 3. Instruction Set Model
3-37
Instruction Set Summary
For more information on
tlbld
and
tlbli
refer to Section 3.2.8, “Implementation-Specific
Instructions.”
Note that the
tlbia
instruction is not implemented on the core.
Refer to Chapter 6, “Memory Management,” for more information about the TLB
operations for the G2 core. Table 3-35 lists the TLB instructions.
Because the presence and exact semantics of the translation lookaside buffer management
instructions is implementation-dependent, system software should incorporate uses of the
instructions into subroutines to maximize compatibility with programs written for other
processors.
For more information on the PowerPC instruction set, refer to Chapter 4, “Addressing
Modes and Instruction Set Summary,” and Chapter 8, “Instruction Set,” in the
Programming Environments Manual
.
3.2.7
Recommended Simplified Mnemonics
To simplify assembly language programs, a set of simplified mnemonics is provided for
some of the most frequently used operations (such as no-op, load immediate, load address,
move register, and complement register). PowerPC compliant assemblers provide the
simplified mnemonics listed in “Recommended Simplified Mnemonics” in Appendix F,
“Simplified Mnemonics,” in the
Programming Environments Manual
,
and listed with some
of the instruction descriptions in this chapter. Programs written to be portable across the
various assemblers for the PowerPC architecture should not assume the existence of
mnemonics not described in this document.
For a complete list of simplified mnemonics, see Appendix F, “Simplified Mnemonics,” in
the
Programming Environments Manual
.
3.2.8
Implementation-Specific Instructions
This section provides a detailed look at the two G2 and one G2_LE core
implementation-specific instructions—
tlbld
,
tlbli
,
and
rfci
,
respectively.
Table 3-35. Translation Lookaside Buffer Management Instructions
Name
Mnemonic
Operand Syntax
Load Data TLB Entry
tlbld
r
B
Load Instruction TLB Entry
tlbli
r
B
TLB Invalidate Entry
tlbie
r
B
TLB Synchronize
tlbsync
—
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
相關PDF資料 |
PDF描述 |
|---|---|
| G2RL-1 | |
| G2RL-14 | |
| G2RL-14-CF | |
| G2RL-14-CFDC12 | |
| G2RL-14DC12 | |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| G2D | 制造商:VISHAY 制造商全稱:Vishay Siliconix 功能描述:GLASS PASSIVATED JUNCTION RECTIFIER |
| G2D/4 | 功能描述:整流器 200 Volt 2.0 Amp RoHS:否 制造商:Vishay Semiconductors 產(chǎn)品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復時間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel |
| G2D01D01024.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D01D01060.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D120-AA04-01 | 制造商:ebm-papst Inc 功能描述:G2D120-AA04-01 |
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