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參數(shù)資料
| 型號： | G2CORERMAD |
| 英文描述： | Errata to G2 PowerPC Core Reference Manual Rev. 0 |
| 中文描述： | 勘誤表的G2 PowerPC的核心參考手冊牧師0 |
| 文件頁數(shù)： | 359/506頁 |
| 文件大小： | 6720K |
| 代理商： | G2CORERMAD |
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MOTOROLA
Chapter 8. Signal Descriptions
8-47
Signal Descriptions
Negated—Indicates that the instruction execution may continue or
resume after the completion of a
tlbsync
instruction.
Assertion/Negation—May occur on any cycle.
Timing Comments
8.3.11.5.1 Output Enable (core_outputs_oe)—Output
For the G2 core, core_outputs_oe is associated with the core_qreq, core_br, core_rsrv, and
core_iabr signals; for the G2_LE core, core_outputs_oe is also associated with core_iabr2,
core_dabr, and core_dabr2. core_outputs_oe does not control any of these signals from the
core. The signals listed above are always driven in normal operation. Following are the
state meaning and timing comments for the core_outputs_oe output signal. Note that no
high-impedance signal is associated with core_outputs_oe.
State Meaning
Asserted—Indicates that the associated output signals are always
driving valid data.
Negated—Indicates that the associated output signals are not driving
valid data (does not occur in normal operation).
Timing Comments
Assertion/Negation—In normal operation core_outputs_oe is
asserted on the third clock cycle after core_hreset is negated.
8.3.12 COP/Scan Interface
The G2 core has extensive on-chip test capability including the following:
Built-in instruction and data cache self-test (BIST)
Debug control/observation (COP)
Boundary scan (IEEE 1149.1 compliant interface)
LSSD test control
The BIST hardware is not used as part of the power-on reset (POR) sequence. The COP and
boundary scan logic are not used under typical operating conditions.
Detailed descriptions of the G2 core test functions is beyond the scope of this document;
however, sufficient information has been provided to allow the system designer to disable
the test functions that would impede normal operation.
The COP/scan interface is shown in Figure 8-4. For more information, see Section 9.9,
“IEEE 1149.1-Compliant Interface.”
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
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PDF描述 |
|---|---|
| G2RL-1 | |
| G2RL-14 | |
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參數(shù)描述 |
|---|---|
| G2D | 制造商:VISHAY 制造商全稱:Vishay Siliconix 功能描述:GLASS PASSIVATED JUNCTION RECTIFIER |
| G2D/4 | 功能描述:整流器 200 Volt 2.0 Amp RoHS:否 制造商:Vishay Semiconductors 產(chǎn)品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復(fù)時間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel |
| G2D01D01024.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D01D01060.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D120-AA04-01 | 制造商:ebm-papst Inc 功能描述:G2D120-AA04-01 |
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