參數(shù)資料
型號(hào)： G2CORERMAD
英文描述： Errata to G2 PowerPC Core Reference Manual Rev. 0
中文描述： 勘誤表的G2 PowerPC的核心參考手冊(cè)牧師0
文件頁(yè)數(shù)： 353/506頁(yè)
文件大小： 6720K
代理商： G2CORERMAD
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MOTOROLA
Chapter 8. Signal Descriptions
8-41
Signal Descriptions
Negation—May be negated two bus cycles after assertion.
8.3.9.5
Checkstop Signals
There is both an checkstop input and checkstop output signal on the G2 core. The core also
implements checkstop output enable and checkstop high-impedance enable signals.
8.3.9.5.1
Checkstop Input (core_ckstp_in)
Following are the state meaning and timing comments for core_ckstp_in.
State Meaning
Asserted—Indicates that the core must terminate operation by
internally gating off all clocks, and releasing all outputs (except
core_ckstp_out) to the high-impedance state. Once core_ckstp_in is
asserted, it must remain asserted until the system has been reset.
Negated—Indicates that normal operation should proceed. See
Section 9.7.2, “Checkstops.”
Timing Comments
Assertion—May occur at any time and may be asserted
asynchronously to the input clocks.
Negation—May occur anytime after core_ckstp_out is asserted.
8.3.9.5.2
Checkstop Output (core_ckstp_out)
The core_ckstp_out signal is output only on the G2 core. The core also implements
checkstop output enable and checkstop high-impedance enable signals. core_ckstp_out
acts as follows:
If core_ckstp_tre is asserted, the output is in one of the following three states—high
impedance, driven high, or driven low.
If core_ckstp_tre is negated, the output is either driven to the high or low state. In
this case, a valid value on core_ckstp_out exists when core_ckstp_oe is asserted.
Following are the state meaning and timing comments for the core_ckstp_out output.
State Meaning
Asserted—Indicates that the core has detected a checkstop condition
and has ceased operation.
Negated—Indicates that the core is operating normally. See
Section 9.7.2, “Checkstops.”
Timing Comments
Assertion—May occur at any time and is asserted asynchronously to
core_sysclk.
Negation—Is negated upon assertion of core_hreset.
High Impedance—Occurs after the negation of core_ckstp_oe, if
core_ckstp_tre is asserted. If core_ckstp_tre is negated,
core_ckstp_out is always driven.
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
相關(guān)PDF資料
PDF描述
G2RL-1
G2RL-14
G2RL-14-CF
G2RL-14-CFDC12
G2RL-14DC12
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
G2D 制造商:VISHAY 制造商全稱(chēng):Vishay Siliconix 功能描述:GLASS PASSIVATED JUNCTION RECTIFIER
G2D/4 功能描述:整流器 200 Volt 2.0 Amp RoHS:否 制造商:Vishay Semiconductors 產(chǎn)品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復(fù)時(shí)間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel
G2D01D01024.0 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY
G2D01D01060.0 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY
G2D120-AA04-01 制造商:ebm-papst Inc 功能描述:G2D120-AA04-01
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