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參數(shù)資料
| 型號： | G2CORERMAD |
| 英文描述： | Errata to G2 PowerPC Core Reference Manual Rev. 0 |
| 中文描述： | 勘誤表的G2 PowerPC的核心參考手冊牧師0 |
| 文件頁數(shù)： | 486/506頁 |
| 文件大?。?/td> | 6720K |
| 代理商： | G2CORERMAD |
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Glossary-10
G2 PowerPC Core Reference Manual
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MOTOROLA
Page fault.
A page fault is a condition that occurs when the processor
attempts to access a memory location that does not reside within a
page
not currently resident in
physical memory
. On PowerPC
processors, a page fault exception condition occurs when a
matching, valid
page table entry
(PTE[V] = 1) cannot be located.
Page table.
A table in memory is comprised of
page table entries
, or PTEs.
It is further organized into eight PTEs per PTEG (page table entry
group). The number of PTEGs in the page table depends on the size
of the page table (as specified in the SDR1 register).
Page table entry (PTE).
Data structures containing information used to
translate
effective address
to physical address on a 4-Kbyte page
basis. A PTE consists of 8 bytes of information in a 32-bit processor
and 16 bytes of information in a 64-bit processor.
Park.
The act of allowing a bus master to maintain bus mastership without
having to arbitrate.
Physical memory.
The actual memory that can be accessed through the
system’s memory bus.
Pipelining.
A technique that breaks operations, such as instruction
processing or bus transactions, into smaller distinct stages or tenures
(respectively) so that a subsequent operation can begin before the
previous one has completed.
Precise exceptions.
A category of exception for which the pipeline can be
stopped so instructions that preceded the faulting instruction can
complete and subsequent instructions can be flushed and
redispatched after exception handling has completed. See
Imprecise
exceptions
.
Primary opcode.
The most-significant 6 bits (bits 0–5) of the instruction
encoding that identifies the type of instruction.
Program order.
The order of instructions in an executing program. More
specifically, this term is used to refer to the original order in which
program instructions are fetched into the instruction queue from the
cache.
Protection boundary.
A boundary between
protection domains
.
Protection domain.
A protection domain is a segment, a virtual page, a BAT
area, or a range of unmapped effective addresses. It is defined only
when the appropriate relocate bit in the MSR (IR or DR) is 1.
F
Freescale Semiconductor, Inc.
n
.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| G2RL-1 | |
| G2RL-14 | |
| G2RL-14-CF | |
| G2RL-14-CFDC12 | |
| G2RL-14DC12 | |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| G2D | 制造商:VISHAY 制造商全稱:Vishay Siliconix 功能描述:GLASS PASSIVATED JUNCTION RECTIFIER |
| G2D/4 | 功能描述:整流器 200 Volt 2.0 Amp RoHS:否 制造商:Vishay Semiconductors 產(chǎn)品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復(fù)時間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel |
| G2D01D01024.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D01D01060.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D120-AA04-01 | 制造商:ebm-papst Inc 功能描述:G2D120-AA04-01 |
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