參數(shù)資料
型號(hào)： G2CORERMAD
英文描述： Errata to G2 PowerPC Core Reference Manual Rev. 0
中文描述： 勘誤表的G2 PowerPC的核心參考手冊(cè)牧師0
文件頁(yè)數(shù)： 430/506頁(yè)
文件大?。?/td> 6720K
代理商： G2CORERMAD
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11-8
G2 PowerPC Core Reference Manual
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MOTOROLA
Synchronization Requirements
This matches when the instruction’s effective address < IABR_ADDR OR the instruction’s
effective address
≤
IABR2_ADDR.
The breakpoint match can be observed externally through watchpoint signals. When
DCBR[SIG_TYPE] or ICBR[SIG_TYPE] is cleared for an OR signal type, the watchpoint
signals—core_iabr, core_iabr2, core_dabr, and core_dabr2—reflect their respective
breakpoints. When DCBR[SIG_TYPE] or ICBR[SIG_TYPE] is set for an AND signal
type, the watchpoint signals core_iabr2 and core_dabr2 are asserted when the AND
condition is met.The watchpoint signal has to asserted for at least one bus clock cycle. For
more details, see Section 2.1.2.14.1, “Instruction Address Breakpoint Control Registers
(IBCR)—G2_LE Only,” and Section 2.1.2.15.1, “Data Address Breakpoint Control
Registers (DBCR)—G2_LE-Only.”
11.6 Synchronization Requirements
An
isync
instruction must follow the setting of the
mtspr
of the breakpoint related registers,
MSR, HID0, IABR, IABR2, DABR, DABR2, IBCR, and DBCR to ensure that the
breakpoint condition is set. IBCR and DBCR should be set before enabling the breakpoint.
The breakpoint should be cleared before changing bits in the IBCR and DCBR. For more
details, see Section 5.5.16, “Instruction Address Breakpoint Exception (0x01300).”
An unrecoverable state occurs at anytime if one of the register values of IABR, IABR2,
DABR, and DABR2 are set to an exception vector. The IABR or IABR2 values must not
be set to match within the instruction address breakpoint exception handler. The DABR or
DABR2 values must not be set to the DSI exception handler. Failure to prohibit a
breakpoint within the instruction address breakpoint exception or DSI handler may result
an unrecoverable and indeterminate processor core state.
If an IABR match and DABR match occur on the same instruction, the instruction address
breakpoint exception is taken before the DSI exception.
If an IABR match occurs on a branch instruction, the instruction address breakpoint
exception is set to the effective address of the branch instruction.
Table 11-6. Address Matching for Outside Address Range
Signal
Condition
Signal
Condition
IABR[CEA]
IABR_ADDR
IABR2[CEA]
IABR2_ADDR
IABR[BE]
1
IABR2[BE]
1
IBCR[CNT]
0
—
—
IBCR[SIG_TYPE]
OR
—
—
IBCR[CMP1]
<
IBCR[CMP2]
>
F
Freescale Semiconductor, Inc.
n
.
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PDF描述
G2RL-1
G2RL-14
G2RL-14-CF
G2RL-14-CFDC12
G2RL-14DC12
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
G2D 制造商:VISHAY 制造商全稱:Vishay Siliconix 功能描述:GLASS PASSIVATED JUNCTION RECTIFIER
G2D/4 功能描述:整流器 200 Volt 2.0 Amp RoHS:否 制造商:Vishay Semiconductors 產(chǎn)品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復(fù)時(shí)間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel
G2D01D01024.0 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY
G2D01D01060.0 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY
G2D120-AA04-01 制造商:ebm-papst Inc 功能描述:G2D120-AA04-01
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