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參數(shù)資料
| 型號： | G2CORERMAD |
| 英文描述： | Errata to G2 PowerPC Core Reference Manual Rev. 0 |
| 中文描述： | 勘誤表的G2 PowerPC的核心參考手冊牧師0 |
| 文件頁數(shù)： | 136/506頁 |
| 文件大?。?/td> | 6720K |
| 代理商： | G2CORERMAD |
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3-28
G2 PowerPC Core Reference Manual
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MOTOROLA
Instruction Set Summary
See Appendix F, “Simplified Mnemonics,” in the
Programming Environments Manual
, for
a complete set of simplified mnemonics.
3.2.4.6
Processor Control Instructions
UISA-level processor control instructions are used to read from and write to the condition
register (CR).
3.2.4.6.1
Move To/From Condition Register Instructions
Table 3-24 lists the instructions provided by the G2 core for reading from or writing to the
CR.
3.2.4.7
Memory Synchronization Instructions—UISA
Memory synchronization instructions control the order in which memory operations are
completed with respect to asynchronous events and the order in which memory operations
are seen by other processors or memory access mechanisms. See Chapter 4, “Instruction
and Data Cache Operation,” for additional information about these instructions and about
related aspects of memory synchronization.
The
sync
instruction delays execution of subsequent instructions until previous instructions
have completed to the point that they can no longer cause an exception and until all
previous memory accesses are performed globally; the
sync
operation is not broadcast onto
the G2 core 60x bus interface. Additionally, all load and store cache/bus activities initiated
by prior instructions are completed. Touch load operations (
dcbt
and
dcbtst
) are required
to complete at least through address translation but are not required to complete on the bus.
The functions performed by the
sync
instruction normally take a significant amount of time
to complete; as a result, frequent use of this instruction may adversely affect performance.
In addition, the number of cycles required to complete a
sync
instruction depends on system
parameters and on the processor's state when the instruction is issued.
The proper paired use of the
lwarx
and
stwcx.
instructions allows programmers to emulate
common semaphore operations such as test and set, compare and swap, exchange memory,
and fetch and add. Examples of these operations can be found in Appendix E,
“Synchronization Programming Examples,” in the
Programming Environments Manual
.
Typically, the
lwarx
instruction should be paired with an
stwcx.
instruction with the same
Table 3-24. Move To/From Condition Register Instructions
Name
Mnemonic
Operand Syntax
Move from Condition Register
mfcr
r
D
Move to Condition Register Fields
mtcrf
CRM
,r
S
Move to Condition Register from XER
mcrxr
crf
D
F
Freescale Semiconductor, Inc.
n
.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| G2RL-1 | |
| G2RL-14 | |
| G2RL-14-CF | |
| G2RL-14-CFDC12 | |
| G2RL-14DC12 | |
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參數(shù)描述 |
|---|---|
| G2D | 制造商:VISHAY 制造商全稱:Vishay Siliconix 功能描述:GLASS PASSIVATED JUNCTION RECTIFIER |
| G2D/4 | 功能描述:整流器 200 Volt 2.0 Amp RoHS:否 制造商:Vishay Semiconductors 產(chǎn)品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復(fù)時間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel |
| G2D01D01024.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D01D01060.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D120-AA04-01 | 制造商:ebm-papst Inc 功能描述:G2D120-AA04-01 |
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