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參數(shù)資料
| 型號： | G2CORERMAD |
| 英文描述： | Errata to G2 PowerPC Core Reference Manual Rev. 0 |
| 中文描述： | 勘誤表的G2 PowerPC的核心參考手冊牧師0 |
| 文件頁數(shù)： | 264/506頁 |
| 文件大?。?/td> | 6720K |
| 代理商： | G2CORERMAD |
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6-32
G2 PowerPC Core Reference Manual
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MOTOROLA
Page Table Search Operation
6.5.2.1
Resources for Table Search Operations
In addition to setting up the translation page tables in memory, the system software must
assist the processor in loading PTEs into the on-chip TLBs. When a required TLB entry is
not found in the appropriate TLB, the processor vectors to one of the three TLB miss
exception handlers so that the software can perform a table search operation and load the
TLB. When this occurs, the processor automatically saves information about the access and
the executing context. Table 6-9 provides a summary of the implementation-specific
exceptions, registers, and instructions that can be used by the TLB miss exception handler
software in G2 core systems. Refer to Chapter 5, “Exceptions,” for more information about
exception processing.
Table 6-9. Implementation-Specific Resources for Table Search Operations
Resource
Name
Description
Exceptions
Instruction TLB miss
exception
(vector offset 0x1000)
No matching entry found in ITLB
Data TLB miss on load
exception
(vector offset 0x1100)
No matching entry found in DTLB for a load data access
Data TLB miss on store
exception—also caused
when changed bit must
be updated
(vector offset 0x1200)
No matching entry found in DTLB for a store data access or matching DLTB
entry has C = 0 and access is a store
Registers
IMISS and DMISS
When a TLB miss exception occurs, the IMISS or DMISS register contains
the 32-bit effective address of the instruction or data access that caused the
miss exception.
ICMP and DCMP
The ICMP and DCMP registers contain the word to be compared with the
first word of a PTE in the table search software routine to determine if a PTE
contains the address translation for the instruction or data access. The
contents of ICMP and DCMP are automatically derived by the core when a
TLB miss exception occurs.
HASH1 and HASH2
The HASH1 and HASH2 registers contain the primary and secondary PTEG
addresses that correspond to the address causing a TLB miss. These
PTEG addresses are automatically derived by the core by performing the
primary and secondary hashing function on the contents of IMISS or
DMISS, for an ITLB or DTLB miss exception, respectively.
RPA
The system software loads a TLB entry by loading the second word of the
matching PTE entry into the RPA register and then executing the
tlbli
or
tlbld
instruction (for loading the ITLB or DTLB, respectively).
Instructions
tlbli r
B
Loads the contents of the ICMP and RPA registers into the ITLB entry
selected by <ea> and SRR1[WAY]
tlbld r
B
Loads the contents of the DCMP and RPA registers into the DTLB entry
selected by <ea> and SRR1[WAY]
F
Freescale Semiconductor, Inc.
n
.
相關PDF資料 |
PDF描述 |
|---|---|
| G2RL-1 | |
| G2RL-14 | |
| G2RL-14-CF | |
| G2RL-14-CFDC12 | |
| G2RL-14DC12 | |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| G2D | 制造商:VISHAY 制造商全稱:Vishay Siliconix 功能描述:GLASS PASSIVATED JUNCTION RECTIFIER |
| G2D/4 | 功能描述:整流器 200 Volt 2.0 Amp RoHS:否 制造商:Vishay Semiconductors 產(chǎn)品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復時間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel |
| G2D01D01024.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D01D01060.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D120-AA04-01 | 制造商:ebm-papst Inc 功能描述:G2D120-AA04-01 |
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