參數(shù)資料
型號(hào)： G2CORERM
英文描述： G2 Core Reference Manual
中文描述： G2核心參考手冊(cè)
文件頁(yè)數(shù)： 93/506頁(yè)
文件大小： 6720K
代理商： G2CORERM
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MOTOROLA
Chapter 2. Register Model
2-9
Register Set
SPRG0–SPRG3 defined in Section 2.1.2.11, “SPRG4–SPRG7 (G2_LE
Only).”
– DSISR. The DSISR defines the cause of data access and alignment
exceptions.
– Machine status save/restore register [0–1] (SRR0, SRR1). The SRR0 and
SRR1 are used to save machine status on exceptions and to restore machine
status when an
rfi
instruction is executed.
Implementation Note
—The G2 core implements the KEY bit (bit 12) in the
SRR1 register to simplify the table search software. For more information
refer to Chapter 6, “Memory Management.”
Note that to support critical interrupts, two new registers, CSRR0 and CSRR1,
are implemented on the G2_LE core, which are not defined by the PowerPC
architecture. These registers have same bit assignments as SRR0 and SRR1,
and are described in Section 2.1.2, “Implementation-Specific Registers.”
— Miscellaneous registers
– The time base facility (TB) for writing. The TB is a 64-bit register pair that
can be used to provide time-of-day or interval timing. It consists of two 32-bit
registers—time base upper (TBU) and time base lower (TBL). The TB is
incremented once every four clock cycles on the core.
– Decrementer (DEC). The DEC register is a 32-bit decrementing counter that
provides a mechanism for causing a decrementer exception after a
programmable delay. The DEC is decremented once every four bus clock
cycles.
– External access register (EAR). The EAR is a 32-bit register used in
conjunction with the
eciwx
and
ecowx
instructions. Although the PowerPC
architecture specifies that EAR26–EAR31 are used to select a device, the G2
core implements only bits 28–31. Note that EAR and the
eciwx
and
ecowx
instructions are optional in the PowerPC architecture and may not be
supported in all processors that implement the OEA.
2.1.2
Implementation-Specific Registers
The G2 core defines the DMISS, IMISS, DCMP, ICMP, HASH1, HASH2, and RPA
registers for software table search operations. These registers should be accessed only when
address translation is disabled (MSR[IR] and MSR[DR] are both zero). For a complete
discussion, refer to Section 6.5.2, “Implementation-Specific Table Search Operation.”
Also, HID0, HID1, and IABR SPRs are defined and described in this section. These
registers can be accessed by supervisor-level instructions only using the SPR numbers
shown in Figure 2-1.
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
相關(guān)PDF資料
PDF描述
G2CORERMAD Errata to G2 PowerPC Core Reference Manual Rev. 0
G2RL-1
G2RL-14
G2RL-14-CF
G2RL-14-CFDC12
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
G2D 制造商:VISHAY 制造商全稱(chēng):Vishay Siliconix 功能描述:GLASS PASSIVATED JUNCTION RECTIFIER
G2D/4 功能描述:整流器 200 Volt 2.0 Amp RoHS:否 制造商:Vishay Semiconductors 產(chǎn)品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復(fù)時(shí)間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel
G2D01D01024.0 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY
G2D01D01060.0 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY
G2D120-AA04-01 制造商:ebm-papst Inc 功能描述:G2D120-AA04-01
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