參數(shù)資料
型號(hào)： G2CORERM
英文描述： G2 Core Reference Manual
中文描述： G2核心參考手冊(cè)
文件頁(yè)數(shù)： 362/506頁(yè)
文件大?。?/td> 6720K
代理商： G2CORERM
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8-50
G2 PowerPC Core Reference Manual
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MOTOROLA
Signal Descriptions
asserted during the assertion of core_hreset in order to properly
initialize the JTAG test access port. The core_trst signal must be
asserted to properly initialize the boundary scan chain. This may be
accomplished by connecting it to core_hreset, using logic to OR any
external JTAG core_trst drivers.
Negated—Indicates normal operation.
Assertion/Negation—This input contains an internal pull-up resistor
to ensure that an unterminated input appears as a high signal level
(negated) to the test logic.
Timing Comments
8.3.12.6 TLM TAP Enable (core_tap_en)—Input
The test linking module test access point enable (core_tap_en) signal is an input on the G2
core. Following are the state meaning and timing comments for the core_tap_en input
signal.
State Meaning
Asserted—Indicates that the test access point controller of the G2
core is in normal mode of operation which is controlled by core_tms.
Negated—Indicates that the core test access point enables the TLM
function.
Timing Comments
Assertion/Negation—This input signal should be either driven at low
logic state during normal operation or not connected to TLM logic.
8.3.12.7 Test Linking Module Select (core_tlmsel)—Output
The test linking module select (core_tlmsel) signal is an output on the G2 core. Following
are the state meaning and timing comments for core_tlmsel.
State Meaning
Asserted—Indicates that the core test access point controller selects
the TLM register by issuing a TLM instruction.
Negated—Indicates normal operation.
Timing Comments
Assertion/Negation—The test access point controller transitions to
run/test/ideal state until the core_tlmsel signal is re-enabled.
8.3.13 Test Interface
Test interface signals like LSSD test clock or test control signals are used in the G2 core for
production testing. core_l1_tstclk, core_l2_tsclk, and core_lssd_mode are the test clock
and test control signals.
F
Freescale Semiconductor, Inc.
n
.
相關(guān)PDF資料
PDF描述
G2CORERMAD Errata to G2 PowerPC Core Reference Manual Rev. 0
G2RL-1
G2RL-14
G2RL-14-CF
G2RL-14-CFDC12
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
G2D 制造商:VISHAY 制造商全稱:Vishay Siliconix 功能描述:GLASS PASSIVATED JUNCTION RECTIFIER
G2D/4 功能描述:整流器 200 Volt 2.0 Amp RoHS:否 制造商:Vishay Semiconductors 產(chǎn)品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復(fù)時(shí)間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel
G2D01D01024.0 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY
G2D01D01060.0 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY
G2D120-AA04-01 制造商:ebm-papst Inc 功能描述:G2D120-AA04-01
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