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參數(shù)資料
| 型號： | G2CORERM |
| 英文描述： | G2 Core Reference Manual |
| 中文描述： | G2核心參考手冊 |
| 文件頁數(shù)： | 418/506頁 |
| 文件大?。?/td> | 6720K |
| 代理商： | G2CORERM |
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10-4
G2 PowerPC Core Reference Manual
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MOTOROLA
Programmable Power Modes
Doze mode is characterized by the following features:
Most functional units disabled
Bus snooping and time base/decrementer still enabled
PLL running and locked to internal core_sysclk
To enter the doze mode, the following conditions must occur:
Set doze bit (HID0[8] = 1), MSR[POW] is set
G2 core enters doze mode after several processor clocks
To return to full-power mode, the following conditions must occur:
Assert internal core_int, core_smi, or core_mcp signals or decrementer interrupts
Hard reset or soft reset
Transition to full-power state occurs only after a few processor cycles
10.3.1.4 Nap Mode
The nap mode disables the G2 core except for the processor PLL and time
base/decrementer. The time base can be used to restore the core to a full-on state after a
specified period.
Because bus snooping is disabled for nap and sleep mode, a hardware handshake using the
quiesce request (core_qreq) and quiesce acknowledge (core_qack) signals are required to
maintain data coherency. The G2 core asserts the core_qreq signal to indicate that it is ready
to disable bus snooping, including all bus activity. Once the processor has entered a
quiescent state, it no longer snoops bus activity.
When the system logic has ensured that snooping is no longer necessary, it allows the
processor to enter the nap (or sleep) mode and causes the assertion of the G2 core core_qack
input signal for the duration of the nap mode period.
Nap mode is characterized by the following features:
Time base/decrementer still enabled
Most functional units disabled (including bus snooping)
PLL running and locked to internal core_sysclk
To enter the nap mode, the following conditions must occur:
Set nap bit (HID0[9] = 1), MSR[POW] bit is set
G2 core asserts core_qreq
System asserts core_qack
The processor core enters nap mode after several processor clocks
F
Freescale Semiconductor, Inc.
n
.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| G2CORERMAD | Errata to G2 PowerPC Core Reference Manual Rev. 0 |
| G2RL-1 | |
| G2RL-14 | |
| G2RL-14-CF | |
| G2RL-14-CFDC12 | |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| G2D | 制造商:VISHAY 制造商全稱:Vishay Siliconix 功能描述:GLASS PASSIVATED JUNCTION RECTIFIER |
| G2D/4 | 功能描述:整流器 200 Volt 2.0 Amp RoHS:否 制造商:Vishay Semiconductors 產(chǎn)品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復(fù)時間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel |
| G2D01D01024.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D01D01060.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D120-AA04-01 | 制造商:ebm-papst Inc 功能描述:G2D120-AA04-01 |
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