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參數(shù)資料
| 型號： | G2CORERM |
| 英文描述： | G2 Core Reference Manual |
| 中文描述： | G2核心參考手冊 |
| 文件頁數(shù)： | 47/506頁 |
| 文件大小： | 6720K |
| 代理商： | G2CORERM |
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MOTOROLA
Chapter 1. Overview
1-5
Overview
— Support for one-level address pipelining and out-of-order bus transactions on the
60x interface
— True little-endian mode (for G2_LE only) for compatibility with other true
little-endian devices.
— Critical interrupt exception (for G2_LE only) is added
— Hardware support for misaligned little-endian accesses
Integrated power management
— Internal processor/bus clock multiplier ratios
— Three power-saving modes: doze, nap, and sleep
— Automatic dynamic power reduction when internal functional units are idle
In-system testability and debugging features through JTAG boundary-scan
capability
Features specific to the G2 core not present on the original MPC603e (PID6-603e)
processors follow:
Enhancements to the register set
— The G2 core has two more additional HID0 bits then the original MPC603e:
– The address bus enable (ABE) bit, HID0[28], gives the G2 core the ability to
broadcast
dcbf
,
dcbi
, and
dcbst
onto the 60x bus.
– The instruction fetch enable M (IFEM) bit, HID0[24], allows the G2 core to
reflect the value of the M bit during instruction translation onto the 60x bus.
— The G2 core has one more additional HID2 register than the original MPC603e
that enables the true little-endian mode, the new additional BAT registers, and
cache way-locking for the G2 core.
Enhancements to cache implementation
— The instruction cache is blocked only until the critical load completes (hit under
reloads allowed)
— The critical-double-word is simultaneously written to the cache and forwarded
to the requesting unit, thus minimizing stalls due to load delays.
— The HID2 register enables instruction and data cache way-locking.
— Provides for an optional data cache operation broadcast feature (enabled by
HID0[ABE]) that allows for correct system management using an external
copy-back L2 cache.
— All of the cache control instructions (
icbi
,
dcbi
,
dcbf
, and
dcbst
, excluding
dcbz
) require that HID0[ABE] be enabled in order to execute.
Exceptions
— The G2 core offers hardware support for misaligned little-endian accesses.
Little-endian load/store accesses that are not on a word boundary, with the
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
相關PDF資料 |
PDF描述 |
|---|---|
| G2CORERMAD | Errata to G2 PowerPC Core Reference Manual Rev. 0 |
| G2RL-1 | |
| G2RL-14 | |
| G2RL-14-CF | |
| G2RL-14-CFDC12 | |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| G2D | 制造商:VISHAY 制造商全稱:Vishay Siliconix 功能描述:GLASS PASSIVATED JUNCTION RECTIFIER |
| G2D/4 | 功能描述:整流器 200 Volt 2.0 Amp RoHS:否 制造商:Vishay Semiconductors 產(chǎn)品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復時間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel |
| G2D01D01024.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D01D01060.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D120-AA04-01 | 制造商:ebm-papst Inc 功能描述:G2D120-AA04-01 |
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