參數(shù)資料
型號(hào)： G2CORERM
英文描述： G2 Core Reference Manual
中文描述： G2核心參考手冊(cè)
文件頁(yè)數(shù)： 254/506頁(yè)
文件大?。?/td> 6720K
代理商： G2CORERM
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6-22
G2 PowerPC Core Reference Manual
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MOTOROLA
Memory Segment Model
The G2 core causes the R bit to be set for the execution of the
dcbt
or
dcbtst
instruction to
that page (by causing a TLB miss exception to load the TLB entry in the case of a TLB
miss). However, neither of these instructions causes the C bit to be set.
As defined by the PowerPC architecture, the referenced and changed bits are updated as if
address translation were disabled (real addressing mode translation). Additionally, these
updates should be performed with single-beat read and byte write transactions on the bus.
6.4.1.1
Referenced Bit
The referenced (R) bit of a page is located in the PTE in the page table. Every time a page
is referenced (with a read or write access) and the R bit is zero, the R bit is then set in the
page table. The OEA specifies that the referenced bit may be set immediately, or the setting
may be delayed until the memory access is determined to be successful. Because the
reference to a page is what causes a PTE to be loaded into the TLB, the referenced bit in all
G2 core TLB entries is effectively always set. The processor never automatically clears the
referenced bit.
The referenced bit is only a hint to the operating system about the activity of a page. At
times, the referenced bit may be set by software although the access was not logically
required by the program, or even if the access was prevented by memory protection.
Examples of this in these systems include the following:
Fetching of instructions not subsequently executed
Accesses generated by an
lswx
or
stswx
instruction with a zero length
Accesses generated by a
stwcx.
instruction when no store is performed because a
reservation does not exist
Accesses that cause exceptions and are not completed
6.4.1.2
Changed Bit
The changed bit of a page is located both in the PTE in the page table and in the copy of the
PTE loaded into the TLB (if a TLB is implemented, as in the G2 core). Whenever a data
store instruction is executed successfully, if the TLB search (for page address translation)
Table 6-7. Table Search Operations to Update History Bits—TLB Hit Case
R and C Bits in
TLB Entry
Processor Action
00
Combination does not occur
01
Combination does not occur
10
Read:
Write:
No special action
Table search operation required to update C.
Causes a data TLB miss on store exception.
11
No special action for read or write
F
Freescale Semiconductor, Inc.
n
.
相關(guān)PDF資料
PDF描述
G2CORERMAD Errata to G2 PowerPC Core Reference Manual Rev. 0
G2RL-1
G2RL-14
G2RL-14-CF
G2RL-14-CFDC12
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
G2D 制造商:VISHAY 制造商全稱(chēng):Vishay Siliconix 功能描述:GLASS PASSIVATED JUNCTION RECTIFIER
G2D/4 功能描述:整流器 200 Volt 2.0 Amp RoHS:否 制造商:Vishay Semiconductors 產(chǎn)品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復(fù)時(shí)間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel
G2D01D01024.0 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY
G2D01D01060.0 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY
G2D120-AA04-01 制造商:ebm-papst Inc 功能描述:G2D120-AA04-01
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