參數(shù)資料
型號(hào)： G2CORERM
英文描述： G2 Core Reference Manual
中文描述： G2核心參考手冊
文件頁數(shù)： 345/506頁
文件大?。?/td> 6720K
代理商： G2CORERM
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MOTOROLA
Chapter 8. Signal Descriptions
8-33
Signal Descriptions
8.3.7.1.3
Data Bus Out (core_dh_out[0:31], core_dl_out[0:31])—Output
The core also implements data bus output enable and data bus high-impedance enable
signals. core_dh_out[0:31] and core_dl_out[0:31] act as follows:
If core_d_tre is asserted, the outputs are in one of the following three states—high
impedance, driven high, or driven low.
If core_d_tre is negated, the outputs are either driven to the high or low state. In this
case, valid values on core_dh_out[0:31] and core_dl_out[0:31] exist when
core_d_oe is asserted.
Following are the state meaning and timing comments for core_dh_out[0:31] and
core_dl_out[0:31].
State Meaning
Asserted/Negated—Represent the state of data during a data write.
Byte lanes not selected for data transfer do not supply valid data.
Timing Comments
Assertion/Negation—Occurs one clock cycle after qualified data bus
grant (coincides with core_dbb_out).
High Impedance—Occurs on the bus clock cycle after core_ta is
asserted, after the negation of core_d_oe, if core_d_tre is asserted. If
core_d_tre is negated, core_dh_out[0:31] and core_dl_out[0:31] are
always driven.
8.3.7.1.4
Data Bus Output Enable (core_d_oe)—Output
core_d_oe is an output-enable indicator to its corresponding bus signals. Following are the
state meaning and timing comments for core_d_oe.
State Meaning
Asserted—Indicates that the core is driving a valid data and data
parity.
Negated—Indicates one of the following two conditions:
If core_d_tre is negated, negated core_d_oe indicates that the core is
not driving valid core_dh_out[0:31] and core_dl_out[0:31] values.
If core_d_tre is asserted, negated core_d_oe indicates that
core_dh_out[0:31] and core_dl_out[0:31] are in the high-impedance
state.
Timing Comments
Assertion/Negation—Occurs one clock cycle after qualified data bus
grant (coincides with core_dbb_out).
Note that negation of core_d_oe may force the data bus and data
attribute signals to the high-impedance state, if core_d_tre is
asserted.
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
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PDF描述
G2CORERMAD Errata to G2 PowerPC Core Reference Manual Rev. 0
G2RL-1
G2RL-14
G2RL-14-CF
G2RL-14-CFDC12
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參數(shù)描述
G2D 制造商:VISHAY 制造商全稱:Vishay Siliconix 功能描述:GLASS PASSIVATED JUNCTION RECTIFIER
G2D/4 功能描述:整流器 200 Volt 2.0 Amp RoHS:否 制造商:Vishay Semiconductors 產(chǎn)品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復(fù)時(shí)間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel
G2D01D01024.0 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY
G2D01D01060.0 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY
G2D120-AA04-01 制造商:ebm-papst Inc 功能描述:G2D120-AA04-01
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