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參數(shù)資料
| 型號： | G2CORERM |
| 英文描述： | G2 Core Reference Manual |
| 中文描述： | G2核心參考手冊 |
| 文件頁數(shù)： | 203/506頁 |
| 文件大?。?/td> | 6720K |
| 代理商： | G2CORERM |
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MOTOROLA
Chapter 5. Exceptions
5-11
Exception Processing
Note that in some implementations, every instruction fetch when MSR[IR] = 1 and every
instruction execution requiring address translation when MSR[DR] = 1 may modify SRR1.
5.2.1.2
CSRR0 and CSRR1 Bit Settings—G2_LE Only
The G2_LE core also implements the CSRR0 and CSRR1 to save state for critical interrupt
exceptions only. Note that the values saved in CSRR0 are the same as those saved in SRR0
for all other exceptions, and the values saved in CSRR1 are the same as those saved in
SRR1 for all other exceptions. However, CSRR0 and CSRR1 have unique SPR numbers,
as described in Chapter 2, “Register Model.”
Figure 5-3 shows the format of CSRR0.
Figure 5-3. Critical Interrupt Save/Restore Register 0 (CSRR0)
When a critical interrupt exception occurs, CSRR0 is set to point to an instruction such that
all prior instructions have completed execution and no subsequent instruction has begun
execution. When an
rfci
instruction is executed, the contents of CSRR0 are copied to the
next instruction address (NIA)—the 32-bit address of the next instruction to be executed.
Figure 5-4 shows the format of CSRR1.
Figure 5-4. Critical Interrupt Save/Restore Register 1 (CSRR1)
When an exception occurs, CSRR1[0–15] are loaded with all zeros and the values of
MSR[16–31] are placed in corresponding CSRR1 bit positions. When
rfci
executes,
MSR[16–31] are loaded from CSRR1[16–31].
CSRR1[0–15] are defined as reserved. An implementation may define one or more of
these bits, and may also cause them to be saved from MSR when an exception is taken,
and restored to MSR from CSRR1 when an
rfci
is executed.
5.2.1.3
SPRG4–SPRG7 (G2_LE Only)
The G2_LE core provides four additional SPRG (SPRG4–SPRG7) registers for general
operating system use, such as performing a fast state save or for supporting multiprocessor
implementations. However, SPRG4–SPRG7 have unique SPR numbers, as described in
Chapter 2, “Register Model.” The formats of SPRG4–SPRG7 are shown in Figure 5-5.
CSRR0
0
29 30
31
Reserved
00
CSRR1
0
31
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| G2CORERMAD | Errata to G2 PowerPC Core Reference Manual Rev. 0 |
| G2RL-1 | |
| G2RL-14 | |
| G2RL-14-CF | |
| G2RL-14-CFDC12 | |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| G2D | 制造商:VISHAY 制造商全稱:Vishay Siliconix 功能描述:GLASS PASSIVATED JUNCTION RECTIFIER |
| G2D/4 | 功能描述:整流器 200 Volt 2.0 Amp RoHS:否 制造商:Vishay Semiconductors 產(chǎn)品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復(fù)時間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel |
| G2D01D01024.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D01D01060.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D120-AA04-01 | 制造商:ebm-papst Inc 功能描述:G2D120-AA04-01 |
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