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參數(shù)資料
| 型號(hào)： | G2CORERM |
| 英文描述： | G2 Core Reference Manual |
| 中文描述： | G2核心參考手冊(cè) |
| 文件頁(yè)數(shù)： | 296/506頁(yè) |
| 文件大?。?/td> | 6720K |
| 代理商： | G2CORERM |
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7-16
G2 PowerPC Core Reference Manual
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MOTOROLA
Execution Unit Timings
— Instructions that directly access the GPRs (load and store multiple word and load
and store string instructions)
— Instructions defined by the architecture to have synchronizing behavior
Dispatch serialized inhibit the dispatching of subsequent instructions until the
serializing instruction is retired. Dispatch serialization is used for instructions that
access renamed resources used by the dispatcher, and for instructions requiring
refetch serialization, including the following:
— The load multiple instructions,
lmw
,
lswi
, and
lswx
.
— The
mtspr
(XER) and
mcrxr
instructions
— The synchronizing instructions,
sync
,
isync
,
mtmsr
,
rfi
,
rfci
(for the G2_LE
core) and
sc
.
Refetch serialized instructions inhibit dispatching of subsequent instructions and
force the refetching of subsequent instructions after the serializing instructions are
retired. The context synchronizing instruction,
isync
, is refetch serializing.
7.3.3.3
Execution Unit Considerations
As previously noted, the G2 core can dispatch and retire two instructions per clock cycle.
The peak dispatch rate is affected by the availability of execution units on each clock cycle.
For an instruction to be dispatched, the required execution unit must be available. The
dispatcher monitors the availability of all execution units and suspends instruction dispatch
if the required execution unit is unavailable. An execution unit may not be available if it
can accept and execute only one instruction per cycle or if an execution unit’s pipeline
becomes full, which may occur if instruction execution takes more clock cycles than the
number of pipeline stages in the unit and additional instructions are dispatched to that unit
to fill the remaining pipeline stages.
7.4
Execution Unit Timings
The following sections describe instruction timing considerations for each execution unit.
7.4.1
Branch Processing Unit Execution Timing
Flow control operations (conditional branches, unconditional branches, and traps) are
typically expensive to execute in most machines because they disrupt normal flow in the
instruction stream. When a change in program flow occurs, the IQ must be reloaded with
the target instruction stream. During this time the execution units will be idle. However,
previously dispatched instructions will continue to execute while the new instruction
stream makes its way into the IQ.
F
Freescale Semiconductor, Inc.
n
.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| G2CORERMAD | Errata to G2 PowerPC Core Reference Manual Rev. 0 |
| G2RL-1 | |
| G2RL-14 | |
| G2RL-14-CF | |
| G2RL-14-CFDC12 | |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| G2D | 制造商:VISHAY 制造商全稱:Vishay Siliconix 功能描述:GLASS PASSIVATED JUNCTION RECTIFIER |
| G2D/4 | 功能描述:整流器 200 Volt 2.0 Amp RoHS:否 制造商:Vishay Semiconductors 產(chǎn)品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復(fù)時(shí)間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel |
| G2D01D01024.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D01D01060.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D120-AA04-01 | 制造商:ebm-papst Inc 功能描述:G2D120-AA04-01 |
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