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參數(shù)資料
| 型號： | G2CORERM |
| 英文描述： | G2 Core Reference Manual |
| 中文描述： | G2核心參考手冊 |
| 文件頁數(shù)： | 105/506頁 |
| 文件大小： | 6720K |
| 代理商： | G2CORERM |
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MOTOROLA
Chapter 2. Register Model
2-21
Register Set
SPR311 in supervisor mode. The present memory base address for the system memory map
is stored in this register. It is important to ensure that the present value of the base offset is
current in the system memory.
2.1.2.14 Instruction Address Breakpoint Registers (IABR and IABR2)
The IABR, shown in Figure 2-14, controls the instruction address breakpoint exception. In
the G2_LE core, an additional address breakpoint register (IABR2) is implemented.
IABR[CEA] holds an effective address to which each instruction’s address is compared.
The exception is enabled by setting IABR[BE]. The exception is taken when there is an
instruction address breakpoint match on the next instruction to complete. The instruction
tagged with the match cannot complete before the breakpoint exception is taken. The
address of the instruction which matches the breakpoint condition is stored in SRR0. The
tagged instruction is completed and retired on return from the exception (
rfi
or
rfci
). The
results are then committed to the destination registers and address.
Note that if the IABR/IABR2 register values are set to any exception vector, an
unrecoverable processor state will occur.
Figure 2-14. Instruction Address Breakpoint Registers (IABR and IABR2)
The bits in the IABR and IABR2 are defined in Table 2-13. For more information about the
instruction breakpoint exception, see Section 5.5.16, “Instruction Address Breakpoint
Exception (0x01300).”
2.1.2.14.1 Instruction Address Breakpoint Control Registers
(IBCR)—G2_LE Only
The IBCR, shown in Figure 2-15, is a supervisor-level register with SPR309 on the G2_LE
core, which is accessible only by using an
mtspr
or
mfspr
instruction. The IBCR controls
the compare and match type conditions for IABR and IABR2. Note that IABR and IABR2
must be enabled before the effects of IBCR are realized.
Table 2-13. Instruction Address Breakpoint Register (IABR and IABR2) Bit Settings
Bits
Name
Description
0–29
CEA
Compare effective address. Word address to be compared.
30
BE
Breakpoint enable. IABR (or IABR2) enabled. Setting this bit enables the IABR exception.
31
—
Reserved
0
29 30 31
CEA
BE 0
Reserved
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| G2CORERMAD | Errata to G2 PowerPC Core Reference Manual Rev. 0 |
| G2RL-1 | |
| G2RL-14 | |
| G2RL-14-CF | |
| G2RL-14-CFDC12 | |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| G2D | 制造商:VISHAY 制造商全稱:Vishay Siliconix 功能描述:GLASS PASSIVATED JUNCTION RECTIFIER |
| G2D/4 | 功能描述:整流器 200 Volt 2.0 Amp RoHS:否 制造商:Vishay Semiconductors 產(chǎn)品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復(fù)時(shí)間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel |
| G2D01D01024.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D01D01060.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D120-AA04-01 | 制造商:ebm-papst Inc 功能描述:G2D120-AA04-01 |
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