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參數資料
| 型號： | G2CORERM |
| 英文描述： | G2 Core Reference Manual |
| 中文描述： | G2核心參考手冊 |
| 文件頁數： | 295/506頁 |
| 文件大?。?/td> | 6720K |
| 代理商： | G2CORERM |
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MOTOROLA
Chapter 7. Instruction Timing
7-15
Timing Considerations
The G2 core can execute instructions out-of-order, but in-order completion by the
completion unit ensures a precise exception mechanism. Program-related exceptions are
signaled when the instruction causing the exception reaches the last position in the
completion queue. Prior instructions are allowed to complete before the exception is taken.
7.3.3.1
Rename Register Operation
To avoid contention for a given register file location, the G2 core provides rename registers
for holding instruction results before the completion commits them to the architected
register. There are five GPR rename registers, four FPR rename registers, and one each for
the CR, LR, and CTR.
When an instruction dispatches to its execution unit, any required rename registers are
allocated for the results of that instruction. If an instruction is dispatched to the reservation
station associated with an execution unit due to a data dependency, the dispatcher also
provides a tag to the execution unit identifying the rename register that forwards the
required data at completion. When the source data reaches the rename register, execution
can begin.
Instruction results are transferred from rename registers to architected registers when an
instruction is retired from the CQ after any associated exceptions are handled and any
predicted branch conditions preceding it in the CQ are resolved. If a branch prediction is
incorrect, the instructions following the branch are flushed from the CQ and any results of
those instructions are flushed from the rename registers.
7.3.3.2
Instruction Serialization
Although the G2 core can dispatch and complete two instructions per cycle, serializing
instructions can be used to limit dispatch and completion to one instruction per cycle.
Serialization falls into three categories—completion, dispatch, and refetch serialization,
which are described as follows:
Completion serialized instructions are held in the execution unit until all prior
instructions in the completion unit have been retired. Completion serialization is
used for instructions that access or modify a resource for which no rename register
exists. Results from these instructions are not available or forwarded for subsequent
instructions until the serializing instruction is retired. Instructions that are
completion serialized are as follows:
— Instructions (with the exception of integer add and compare instructions)
executed by the system register unit (SRU)
— Floating-point instructions that access or modify the FPSCR or CR (
mtfsb1
,
mcrfs
,
mtfsfi
,
mffs
, and
mtfsf
).
— Instructions that manage caches and TLBs
F
Freescale Semiconductor, Inc.
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Go to: www.freescale.com
n
.
相關PDF資料 |
PDF描述 |
|---|---|
| G2CORERMAD | Errata to G2 PowerPC Core Reference Manual Rev. 0 |
| G2RL-1 | |
| G2RL-14 | |
| G2RL-14-CF | |
| G2RL-14-CFDC12 | |
相關代理商/技術參數 |
參數描述 |
|---|---|
| G2D | 制造商:VISHAY 制造商全稱:Vishay Siliconix 功能描述:GLASS PASSIVATED JUNCTION RECTIFIER |
| G2D/4 | 功能描述:整流器 200 Volt 2.0 Amp RoHS:否 制造商:Vishay Semiconductors 產品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復時間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel |
| G2D01D01024.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D01D01060.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D120-AA04-01 | 制造商:ebm-papst Inc 功能描述:G2D120-AA04-01 |
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