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參數(shù)資料
| 型號(hào)： | G2CORERM |
| 英文描述： | G2 Core Reference Manual |
| 中文描述： | G2核心參考手冊 |
| 文件頁數(shù)： | 27/506頁 |
| 文件大?。?/td> | 6720K |
| 代理商： | G2CORERM |
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Tables
Table
Number
Title
Page
Number
MOTOROLA
Tables
xxvii
4-18
5-1
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7-1
7-2
7-3
7-4
G2 Core IWLCK[0–2] Encodings.............................................................................4-42
Exception Classifications ............................................................................................5-3
Exceptions and Conditions..........................................................................................5-4
Exception Priorities.....................................................................................................5-6
SRR1 Bit Settings for Machine Check Exceptions...................................................5-10
SRR1 Bit Settings for Software Table Search Operations ........................................5-10
Conventional Uses of SPRG4–SPRG7 .....................................................................5-12
MSR Bit Settings.......................................................................................................5-12
IEEE Floating-Point Exception Mode Bits ...............................................................5-14
MSR Setting Due to Exception .................................................................................5-18
Hard Reset MSR Value and Exception Vector..........................................................5-20
Settings Caused by Hard Reset..................................................................................5-20
Soft Reset Exception—Register Settings..................................................................5-21
Machine Check Exception—Register Settings .........................................................5-24
DSI Exception—Register Settings ............................................................................5-25
External Interrupt—Register Settings .......................................................................5-28
Alignment Interrupt—Register Settings....................................................................5-29
Access Types .............................................................................................................5-30
Critical Interrupt—Register Settings.........................................................................5-34
Trace Exception—Register Settings..........................................................................5-35
Instruction and Data TLB Miss Exceptions—Register Settings...............................5-37
Instruction Address Breakpoint Exception—Register Settings ................................5-38
Breakpoint Action for Multiple Modes Enabled for the Same Address....................5-39
System Management Interrupt—Register Settings...................................................5-40
MMU Features Summary............................................................................................6-2
Access Protection Options for Pages.........................................................................6-10
Translation Exception Conditions .............................................................................6-15
Other MMU Exception Conditions ...........................................................................6-16
Instruction Summary—MMU Control......................................................................6-17
MMU Registers.........................................................................................................6-18
Table Search Operations to Update History Bits—TLB Hit Case ............................6-22
Model for Guaranteed R and C Bit Settings..............................................................6-24
Implementation-Specific Resources for Table Search Operations............................6-32
Implementation-Specific SRR1 Bits .........................................................................6-33
DCMP and ICMP Bit Settings ..................................................................................6-35
HASH1 and HASH2 Bit Settings..............................................................................6-35
RPA Bit Settings........................................................................................................6-36
Branch Instructions....................................................................................................7-26
System Register Instructions.....................................................................................7-26
Condition Register Logical Instructions....................................................................7-27
Integer Instructions....................................................................................................7-27
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
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PDF描述 |
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參數(shù)描述 |
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| G2D | 制造商:VISHAY 制造商全稱:Vishay Siliconix 功能描述:GLASS PASSIVATED JUNCTION RECTIFIER |
| G2D/4 | 功能描述:整流器 200 Volt 2.0 Amp RoHS:否 制造商:Vishay Semiconductors 產(chǎn)品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復(fù)時(shí)間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel |
| G2D01D01024.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D01D01060.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D120-AA04-01 | 制造商:ebm-papst Inc 功能描述:G2D120-AA04-01 |
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