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參數(shù)資料
| 型號： | G2CORERM |
| 英文描述： | G2 Core Reference Manual |
| 中文描述： | G2核心參考手冊 |
| 文件頁數(shù)： | 90/506頁 |
| 文件大小： | 6720K |
| 代理商： | G2CORERM |
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2-6
G2 PowerPC Core Reference Manual
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MOTOROLA
Register Set
– Machine state register (MSR). The MSR defines the state of the processor.
The MSR can be modified by the Move to Machine State Register
(
mtmsr
),
System Call (
sc
), and Return from Exception (
rfi
) and Return from Critical
Exception (
rfci
) instructions. It can be read by the Move from Machine State
Register (
mfmsr
) instruction.
Implementation Note
—The G2 core defines MSR[13] as the power
management enable (POW) bit and MSR[14] as the temporary GPR
remapping (TGPR) bit. The G2_LE allocates MSR[24] for enabling the
critical interrupt and
rfci,
the return from critical interrupt instruction.
MSR[31] is used in conjunction with HID2[LET] to indicate the endian mode
of operation of the G2_LE core. These bits are described in Table 2-4.
MPC603e (PID7v)
0x0007
0x0100,
0x0201
Space for future versions
Table 2-4. MSR Bit Settings
Bits
Name
Description
0
—
Reserved. Full function.
1–4
—
Reserved. Partial function.
5–9
—
Reserved. Full function.
10–12
—
Reserved. Partial function.
13
POW
Power management enable (implementation-specific)
0 Disables programmable power modes (normal operation mode)
1 Enables programmable power modes (nap, doze, or sleep mode).
This bit controls the programmable power modes only; it has no effect on dynamic power
management (DPM). MSR[POW] may be altered with an
mtmsr
instruction only. Also, when
altering the POW bit, software may alter only this bit in the MSR and no others. The
mtmsr
instruction must be followed by a context-synchronizing instruction.
See Chapter 10, “Power Management,” for more information.
14
TGPR
Temporary GPR remapping (implementation-specific)
0 Normal operation
1 TGPR mode. GPR0–GPR3 are remapped to TGPR0–TGPR3 for use by TLB miss routines.
The contents of GPR0–GPR3 remain unchanged while MSR[TGPR] = 1. Attempts to use
GPR4–GPR31 with MSR[TGPR] = 1 yield undefined results. Temporarily replaces
TGPR0–TGPR3 with GPR0–GPR3 for use by TLB miss routines. The TGPR bit is set when
either an instruction TLB miss, data read miss, or data write miss exception is taken. The
TGPR bit is cleared by an
rfi
instruction.
Table 2-3. Assigned PVR Values (continued)
Device Name
Version No.
Revision No.
F
Freescale Semiconductor, Inc.
n
.
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PDF描述 |
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| G2CORERMAD | Errata to G2 PowerPC Core Reference Manual Rev. 0 |
| G2RL-1 | |
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參數(shù)描述 |
|---|---|
| G2D | 制造商:VISHAY 制造商全稱:Vishay Siliconix 功能描述:GLASS PASSIVATED JUNCTION RECTIFIER |
| G2D/4 | 功能描述:整流器 200 Volt 2.0 Amp RoHS:否 制造商:Vishay Semiconductors 產(chǎn)品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復時間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel |
| G2D01D01024.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D01D01060.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D120-AA04-01 | 制造商:ebm-papst Inc 功能描述:G2D120-AA04-01 |
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