參數(shù)資料
型號(hào)： G2CORERM
英文描述： G2 Core Reference Manual
中文描述： G2核心參考手冊(cè)
文件頁(yè)數(shù)： 236/506頁(yè)
文件大小： 6720K
代理商： G2CORERM
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6-4
G2 PowerPC Core Reference Manual
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MOTOROLA
MMU Features
of program flow. Data addresses shown in Figure 6-3 are generated by load and store
instructions and by cache instructions.
As shown in the figures, after an address is generated, the higher-order bits of the effective
address, EA0–EA19 (or a smaller set of address bits, EA0–EA
n
, in the cases of blocks), are
translated into physical address bits PA0–PA19. The lower-order address bits, A20–A31,
are untranslated and, therefore, identical for both effective and physical addresses. After
translating the address, the MMUs pass the resulting 32-bit physical address to the memory
subsystem.
In addition to the higher-order address bits, the MMUs automatically keep an indicator of
whether each access was generated as an instruction or data access and a supervisor/user
indicator that reflects the state of the PR bit of the MSR when the effective address was
generated. In addition, for data accesses, there is an indicator of whether the access is for a
load or a store operation. This information is then used by the MMUs to appropriately direct
the address translation and to enforce the protection hierarchy programmed by the
operating system. Section 5.2, “Exception Processing,” describes the MSR, which controls
some of the critical functionality of the MMUs.
The figures show how the A20–A26 address bits index into the on-chip instruction and data
caches to select a cache set. The remaining physical address bits are then compared with
the tag fields (comprised of bits PA0–PA19) of the four selected cache blocks to determine
if a cache hit has occurred. In the case of a cache miss, the instruction or data access is then
forwarded to the bus interface unit which then initiates a 60x bus access to the memory
subsystem.
F
Freescale Semiconductor, Inc.
n
.
相關(guān)PDF資料
PDF描述
G2CORERMAD Errata to G2 PowerPC Core Reference Manual Rev. 0
G2RL-1
G2RL-14
G2RL-14-CF
G2RL-14-CFDC12
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
G2D 制造商:VISHAY 制造商全稱:Vishay Siliconix 功能描述:GLASS PASSIVATED JUNCTION RECTIFIER
G2D/4 功能描述:整流器 200 Volt 2.0 Amp RoHS:否 制造商:Vishay Semiconductors 產(chǎn)品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復(fù)時(shí)間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel
G2D01D01024.0 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY
G2D01D01060.0 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY
G2D120-AA04-01 制造商:ebm-papst Inc 功能描述:G2D120-AA04-01
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