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參數(shù)資料
| 型號(hào)： | G2CORERM |
| 英文描述： | G2 Core Reference Manual |
| 中文描述： | G2核心參考手冊(cè) |
| 文件頁數(shù)： | 355/506頁 |
| 文件大?。?/td> | 6720K |
| 代理商： | G2CORERM |
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MOTOROLA
Chapter 8. Signal Descriptions
8-43
Signal Descriptions
State Meaning
Asserted—Initiates a hard reset operation. Causes a reset exception
as described in Section 5.5.1.1, “Hard Reset and Power-On Reset.”
Output drivers are released to high impedance within five clock
cycles after the assertion of core_hreset.
Negated—Indicates that normal operation should proceed. See
Section 9.7.3, “Reset Inputs.” The reset configuration signals are
also sampled at the negation of core_hreset.
Assertion—May occur at any time and may be asserted
asynchronously to the core input clock; must be held asserted for a
minimum of 255 clock cycles after the PLL lock time has been met.
Refer to the appropriate hardware specifications for further timing
comments.
Negation—May occur any time after the minimum reset pulse width
has been met.
Timing Comments
8.3.10.2 Soft Reset (core_sreset)—Input
The core_sreset signal is input only. Following are the state meaning and timing comments
for the core_sreset input.
State Meaning
Asserted— Initiates processing for a reset exception as described in
Section 5.5.1.2, “Soft Reset.”
Negated—Indicates that normal operation should proceed. See
Section 9.7.3, “Reset Inputs.”
Timing Comments
Assertion—May occur at any time and may be asserted
asynchronously to the core input clock. core_sreset is negative
edge-sensitive.
Negation—May be negated two bus cycles after assertion.
8.3.10.3 Reset Configuration Signals
There are five reset configuration signals on the G2 core that are sampled at the negation
of core_hreset.
8.3.10.3.1 32-Bit Mode (core_32bitmode)—Input
Following are the state meaning and timing comments for the core_32bitmode input.
State Meaning
Asserted—Causes the core to be configured for 32-bit mode
operation. See Section 9.6.1, “32-Bit Data Bus Mode,” for more
information on the differences between 32- and 64-bit mode
operation.
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| G2CORERMAD | Errata to G2 PowerPC Core Reference Manual Rev. 0 |
| G2RL-1 | |
| G2RL-14 | |
| G2RL-14-CF | |
| G2RL-14-CFDC12 | |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| G2D | 制造商:VISHAY 制造商全稱:Vishay Siliconix 功能描述:GLASS PASSIVATED JUNCTION RECTIFIER |
| G2D/4 | 功能描述:整流器 200 Volt 2.0 Amp RoHS:否 制造商:Vishay Semiconductors 產(chǎn)品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復(fù)時(shí)間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel |
| G2D01D01024.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D01D01060.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D120-AA04-01 | 制造商:ebm-papst Inc 功能描述:G2D120-AA04-01 |
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