參數(shù)資料
型號(hào)： G2CORERM
英文描述： G2 Core Reference Manual
中文描述： G2核心參考手冊(cè)
文件頁(yè)數(shù)： 303/506頁(yè)
文件大小： 6720K
代理商： G2CORERM
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MOTOROLA
Chapter 7. Instruction Timing
7-23
Instruction Scheduling Guidelines
7.5.2
Write-Through Mode
Store operations to memory in write-through mode always update memory as well as the
on-chip cache (on cache hits). Write-through mode is used when the data in the cache must
always agree with external memory (for example, video memory), when shared (global)
data may be used frequently, or when allocation of a cache line on a cache miss is
undesirable. Automatic copy back of cached data is not performed if that data is from a
memory page marked as write-through mode because valid cache data always agrees with
memory.
Stores to memory that are in write-through mode may cause a decrease in performance.
Each time a store is performed to memory in write-through mode, the bus is potentially
busy for the extra clock cycles required to update memory; therefore, load operations that
miss the on-chip cache must wait while the external store operation completes.
7.5.3
Cache-Inhibited Accesses
Data for a page marked cache-inhibited cannot be stored in the on-chip cache.
Areas of the memory map can be cache-inhibited by the operating system. If a
cache-inhibited access hits in the on-chip cache, the corresponding cache line is
invalidated. If the line is marked modified, it is copied back to memory before being
invalidated.
In summary, the copy-back mode allows both load and store operations to use the on-chip
cache. The write-through mode allows load operations to use the on-chip cache, but store
operations cause a memory access and a cache update if the data is already in the cache.
Lastly, the cache-inhibited mode causes memory access for both loads and stores.
7.6
Instruction Scheduling Guidelines
The performance of the G2 core can be improved by avoiding resource conflicts and
promoting parallel utilization of execution units through efficient instruction scheduling.
Instruction scheduling on the G2 core can be improved by observing the following
guidelines:
Implement good static branch prediction (setting of y bit in BO field).
When branch prediction is uncertain, or an even probability, predict fall through.
To reduce mispredictions, separate the instruction that sets CR bits from the branch
instruction that evaluates them; separation by more than nine instructions ensures
that the CR bits will be immediately available for evaluation.
When branching conditionally to a location specified by count registers (CTRs) or
link registers (LRs), or when branching conditionally based on the value in the count
register, separate the
mtspr
instruction that initializes the CTR or LR from the
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
相關(guān)PDF資料
PDF描述
G2CORERMAD Errata to G2 PowerPC Core Reference Manual Rev. 0
G2RL-1
G2RL-14
G2RL-14-CF
G2RL-14-CFDC12
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
G2D 制造商:VISHAY 制造商全稱:Vishay Siliconix 功能描述:GLASS PASSIVATED JUNCTION RECTIFIER
G2D/4 功能描述:整流器 200 Volt 2.0 Amp RoHS:否 制造商:Vishay Semiconductors 產(chǎn)品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復(fù)時(shí)間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel
G2D01D01024.0 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY
G2D01D01060.0 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY
G2D120-AA04-01 制造商:ebm-papst Inc 功能描述:G2D120-AA04-01
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