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參數(shù)資料
| 型號(hào)： | G2CORERM |
| 英文描述： | G2 Core Reference Manual |
| 中文描述： | G2核心參考手冊(cè) |
| 文件頁(yè)數(shù)： | 28/506頁(yè) |
| 文件大?。?/td> | 6720K |
| 代理商： | G2CORERM |
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Tables
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Title
Page
Number
xxviii
G2 PowerPC Core Reference Manual
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MOTOROLA
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A-1
A-2
A-3
A-4
A-5
A-6
A-7
A-8
Floating-Point Instructions........................................................................................7-29
Load and Store Instructions.......................................................................................7-30
Input/Output Enable and High-Impedance Signal Mappings......................................8-4
Conditions for Unidirectional/Bidirectional Signals...................................................8-5
Truth Table for Bidirectional Signals..........................................................................8-6
G2 Core Signal Cross Reference.................................................................................8-6
G2 Core Snoop Hit Response....................................................................................8-20
Transfer Type Encoding for the G2 Core as a Bus Master........................................8-21
Implementation-Specific Transfer Type Encoding....................................................8-22
Data Transfer Size .....................................................................................................8-23
Encodings for core_tc[0:1] Signals ...........................................................................8-24
Data Bus Lane Assignments......................................................................................8-32
Data Bus Parity Signal Assignments.........................................................................8-34
core_clk_out Signal Configuration............................................................................8-54
Core PLL Configuration............................................................................................8-55
Timing Diagram Legend..............................................................................................9-8
Transfer Size Signal Encodings.................................................................................9-13
Burst Ordering—64-Bit Bus......................................................................................9-14
Burst Ordering—32-Bit Bus......................................................................................9-14
Aligned Data Transfers (64-Bit Bus).........................................................................9-15
Misaligned Data Transfers (4-Byte Examples).........................................................9-16
Aligned Data Transfers (32-Bit Bus Mode)..............................................................9-17
Misaligned 32-Bit Data Bus Transfer (4-Byte Examples) ........................................9-18
Transfer Code Encoding............................................................................................9-19
core_cse[0:1] Signals.................................................................................................9-30
IEEE Interface Pin Descriptions................................................................................9-43
G2 core Programmable Power Modes.......................................................................10-3
Other Debug and Support Register Bits.................................................................... 11-3
Related Debug Exceptions and Conditions............................................................... 11-6
Single Address Matching (G2 Core Emulation) ....................................................... 11-7
Two Addresses OR Matching.................................................................................... 11-7
Address Matching for Inside Address Range............................................................ 11-7
Address Matching for Outside Address Range......................................................... 11-8
Complete Instruction List Sorted by Mnemonic........................................................ A-1
Complete Instruction List Sorted by Opcode............................................................. A-8
Integer Arithmetic Instructions................................................................................ A-15
Integer Compare Instructions................................................................................... A-16
Integer Logical Instructions..................................................................................... A-16
Integer Rotate Instructions....................................................................................... A-17
Integer Shift Instructions.......................................................................................... A-17
Floating-Point Arithmetic Instructions .................................................................... A-18
F
Freescale Semiconductor, Inc.
n
.
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PDF描述 |
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| G2RL-1 | |
| G2RL-14 | |
| G2RL-14-CF | |
| G2RL-14-CFDC12 | |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| G2D | 制造商:VISHAY 制造商全稱(chēng):Vishay Siliconix 功能描述:GLASS PASSIVATED JUNCTION RECTIFIER |
| G2D/4 | 功能描述:整流器 200 Volt 2.0 Amp RoHS:否 制造商:Vishay Semiconductors 產(chǎn)品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復(fù)時(shí)間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel |
| G2D01D01024.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D01D01060.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D120-AA04-01 | 制造商:ebm-papst Inc 功能描述:G2D120-AA04-01 |
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