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參數(shù)資料
| 型號： | G2CORERM |
| 英文描述： | G2 Core Reference Manual |
| 中文描述： | G2核心參考手冊 |
| 文件頁數(shù)： | 17/506頁 |
| 文件大小： | 6720K |
| 代理商： | G2CORERM |
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Contents
Paragraph
Number
Title
Page
Number
MOTOROLA
Contents
xvii
8.3.10.3.4
8.3.10.3.5
8.3.10.3.6
8.3.11
8.3.11.1
8.3.11.2
8.3.11.3
8.3.11.4
8.3.11.5
8.3.11.5.1
8.3.12
8.3.12.1
8.3.12.2
8.3.12.3
8.3.12.3.1
8.3.12.4
8.3.12.5
8.3.12.6
8.3.12.7
8.3.13
8.3.13.1
8.3.13.2
8.3.13.3
8.3.14
8.3.14.1
DRTRY Mode (core_drtrymode)—Input..............................................8-44
True Little-Endian Mode (core_tle)—Input..........................................8-45
System Version Register (core_svr[0:31])—Input................................8-45
Processor Status Signals ................................................................................8-45
Quiescent Acknowledge (core_qack)—Input............................................8-45
Quiescent Request (core_qreq)—Output...................................................8-46
Reservation (core_rsrv)—Output ..............................................................8-46
Time Base Enable (core_tben)—Input......................................................8-46
TLBI Sync (core_tlbisync)—Input............................................................8-46
Output Enable (core_outputs_oe)—Output...........................................8-47
COP/Scan Interface........................................................................................8-47
JTAG Test Clock (core_tck)—Input..........................................................8-48
JTAG Test Data Input (core_tdi)—Input...................................................8-48
JTAG Test Data Output (core_tdo)—Output.............................................8-49
JTAG Test Data Output Enable (core_tdo_oe)—Output.......................8-49
JTAG Test Mode Select (core_tms)—Input ..............................................8-49
JTAG Test Reset (core_trst)—Input..........................................................8-49
TLM TAP Enable (core_tap_en)—Input...................................................8-50
Test Linking Module Select (core_tlmsel)—Output .................................8-50
Test Interface..................................................................................................8-50
Disable (core_disable)—Input...................................................................8-51
LSSD Test Clock (core_l1_tstclk, core_l2_tstclk)—Input........................8-51
LSSD Test Control (core_lssd_mode)—Input...........................................8-51
Debug Control Signals...................................................................................8-51
Instruction Address Breakpoint Register Watchpoint
(core_iabr)—Output ..............................................................................8-52
Instruction Address Breakpoint Register Watchpoint
(core_iabr2)—Output ............................................................................8-52
Data Address Breakpoint Register Watchpoint (core_dabr)—Output ......8-52
Data Address Breakpoint Register Watchpoint (core_dabr2)—Output ....8-53
Clock Signals.................................................................................................8-53
System Clock (core_sysclk)—Input..........................................................8-53
Test Clock Output (core_clk_out) .............................................................8-54
PLL Configuration (core_pll_cfg[0:4])—Input.........................................8-55
8.3.14.2
8.3.14.3
8.3.14.4
8.3.15
8.3.15.1
8.3.15.2
8.3.15.3
Chapter 9
Core Interface Operation
9.1
9.1.1
9.1.2
9.1.3
Overview..............................................................................................................9-1
Operation of the Instruction and Data Caches.................................................9-2
Operation of the System Interface...................................................................9-4
Optional 32-Bit Data Bus Mode......................................................................9-5
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
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PDF描述 |
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| G2D01D01024.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D01D01060.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D120-AA04-01 | 制造商:ebm-papst Inc 功能描述:G2D120-AA04-01 |
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