參數(shù)資料
型號(hào)： G2CORERM
英文描述： G2 Core Reference Manual
中文描述： G2核心參考手冊(cè)
文件頁(yè)數(shù)： 225/506頁(yè)
文件大小： 6720K
代理商： G2CORERM
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MOTOROLA
Chapter 5. Exceptions
5-33
Exception Definitions
Register settings for this exception are described in Chapter 6, “Exceptions,” in the
Programming Environments Manual.
When a decrementer exception is taken, instruction execution for the handler begins at
offset 0x00900 from the physical base address indicated by MSR[IP].
5.5.10 Critical Interrupt Exception (0x00A00)—G2_LE Only
A critical interrupt is signaled to the G2_LE core by the assertion of the core_int signal as
described in Section 8.3.9.2, “Critical Interrupt (core_cint)—Input: G2_LE Core-Only.”
The interrupt may not be recognized if a higher priority exception occurs simultaneously or
if the MSR[CE] bit is cleared when core_cint is asserted.
The following events occur when the G2_LE recognizes the assertion of core_cint:
Multi-cycle instructions not in the completion stage are terminated
Outstanding load or store instructions that have not been completed are terminated
Any outstanding page table search activity is terminated
The effective address for resuming program execution is saved into CSRR0
The contents of MSR are saved into CSRR1
The MSR register is loaded with all zeros except the IP, ILE, and ME bits which
remain unchanged
Exception processing starts at offset value 0x00A00 from the physical base address
indicated by MSR[IP]
Some types of instructions (for example load multiple/string and floating-point
instructions) cause additional interrupt recognition latency. Timing critical applications
must consider these instruction execution latencies in calculating worst-case interrupt
recognition latency.
Upon returning from a critical interrupt handler routine the core restarts any terminated or
uncompleted instructions, including terminated load multiple or load string instructions.
Note that these restarted load instructions may cause side-effects on peripheral devices that
have auto-decrementer or status bit changes caused by the subsequent load accesses.
The register settings for the critical interrupt are shown in Table 5-15.
F
Freescale Semiconductor, Inc.
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Go to: www.freescale.com
n
.
相關(guān)PDF資料
PDF描述
G2CORERMAD Errata to G2 PowerPC Core Reference Manual Rev. 0
G2RL-1
G2RL-14
G2RL-14-CF
G2RL-14-CFDC12
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
G2D 制造商:VISHAY 制造商全稱(chēng):Vishay Siliconix 功能描述:GLASS PASSIVATED JUNCTION RECTIFIER
G2D/4 功能描述:整流器 200 Volt 2.0 Amp RoHS:否 制造商:Vishay Semiconductors 產(chǎn)品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復(fù)時(shí)間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel
G2D01D01024.0 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY
G2D01D01060.0 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY
G2D120-AA04-01 制造商:ebm-papst Inc 功能描述:G2D120-AA04-01
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