參數(shù)資料
型號(hào)： G2CORERM
英文描述： G2 Core Reference Manual
中文描述： G2核心參考手冊(cè)
文件頁(yè)數(shù)： 43/506頁(yè)
文件大小： 6720K
代理商： G2CORERM
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MOTOROLA
Chapter 1. Overview
1-1
Chapter 1
Overview
This chapter provides an overview of features for the embedded G2 processor core, a
derivative of the original MPC603e PowerPC microprocessor design. The G2 core is an
implementation of the PowerPC microprocessor family. This reference manual also
describes the G2_LE core, which is a derivative of the G2 core The G2_LE core
implements some enhanced features with a true little-endian mode, an additional critical
interrupt signal, and four additional instruction BAT and four additional data BAT registers.
This document is written from the perspective of the G2 core and all of the descriptions
apply to both the G2 and G2_LE cores, except where explicitly noted. Note that throughout
this document, the terms G2 core, core, and processor are used interchangeably.
1.1
Overview
This section describes the details of the G2 core, provides a block diagram showing the
major functional units (see Figure 1-1), and briefly describes how these units interact. All
differences between the G2 and G2_LE implementations are noted.
The G2 core is a low-power implementation of this microprocessor family of reduced
instruction set computing (RISC) microprocessors. The core implements the 32-bit portion
of the PowerPC architecture, which defines 32-bit effective addresses, integer data types of
8, 16, and 32 bits, and floating-point data types of 32 and 64 bits.
The G2 core is a superscalar processor that can issue and retire as many as three instructions
per clock cycle. Instructions can execute out of program order for increased performance;
however, the core makes completion appear sequential.
The G2 core integrates five execution units—an integer unit (IU), a floating-point unit
(FPU), a branch processing unit (BPU), a load/store unit (LSU), and a system register unit
(SRU). The ability to execute five instructions in parallel and the use of simple instructions
with rapid execution times yield high efficiency and throughput for G2-core based systems.
Most integer instructions execute in one clock cycle. On the G2 core, the FPU is pipelined
so a single-precision multiply-add instruction can be issued and completed every clock
cycle. The G2 core provides hardware support for all single- and double-precision
floating-point operations for most value representations and all rounding modes.
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
相關(guān)PDF資料
PDF描述
G2CORERMAD Errata to G2 PowerPC Core Reference Manual Rev. 0
G2RL-1
G2RL-14
G2RL-14-CF
G2RL-14-CFDC12
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
G2D 制造商:VISHAY 制造商全稱(chēng):Vishay Siliconix 功能描述:GLASS PASSIVATED JUNCTION RECTIFIER
G2D/4 功能描述:整流器 200 Volt 2.0 Amp RoHS:否 制造商:Vishay Semiconductors 產(chǎn)品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復(fù)時(shí)間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel
G2D01D01024.0 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY
G2D01D01060.0 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY
G2D120-AA04-01 制造商:ebm-papst Inc 功能描述:G2D120-AA04-01
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