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參數(shù)資料
| 型號： | G2CORERM |
| 英文描述： | G2 Core Reference Manual |
| 中文描述： | G2核心參考手冊 |
| 文件頁數(shù)： | 243/506頁 |
| 文件大?。?/td> | 6720K |
| 代理商： | G2CORERM |
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MOTOROLA
Chapter 6. Memory Management
6-11
MMU Features
6.1.5
Page History Information
The MMUs of these processors also define referenced (R) and changed (C) bits in the page
address translation mechanism that can be used as history information relevant to the page.
This information can then be used by the operating system to determine the areas of
memory to write back to disk when new pages must be allocated in main memory. While
these bits are initially programmed by the operating system into the page table, the
architecture specifies that the R and C bits may be maintained either by the processor
hardware (automatically) or by some software-assist mechanism that updates these bits
when required as needed by the G2 core. The software table search routines used by the G2
core set the R bit when a PTE is accessed; the core causes an exception (to vector to the
software table search routines) when the C bit in the corresponding TLB entry requires
updating. See Section 6.4.1.3, “Scenarios for Referenced and Changed Bit Recording,” for
more details.
6.1.6
General Flow of MMU Address Translation
The following sections describe the general flow used by processors that implement the
PowerPC architecture to translate effective addresses to virtual and then physical addresses.
6.1.6.1
Real Addressing Mode and Block Address Translation
Selection
When an instruction or data access is generated and the corresponding instruction or data
translation is disabled (MSR[IR] = 0 or MSR[DR] = 0), real addressing mode translation is
used (physical address equals effective address) and the access continues to the memory
subsystem as described in Section 6.2, “Real Addressing Mode.”
Figure 6-5 shows the flow used by the MMUs in determining whether to select real
addressing mode, block address translation, or to use the segment descriptor to select page
address translation.
Note that if the BAT array search results in a hit, the access is qualified with the appropriate
protection bits. If the access violates the protection mechanism, an exception (ISI or DSI
exception) is generated.
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| G2CORERMAD | Errata to G2 PowerPC Core Reference Manual Rev. 0 |
| G2RL-1 | |
| G2RL-14 | |
| G2RL-14-CF | |
| G2RL-14-CFDC12 | |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| G2D | 制造商:VISHAY 制造商全稱:Vishay Siliconix 功能描述:GLASS PASSIVATED JUNCTION RECTIFIER |
| G2D/4 | 功能描述:整流器 200 Volt 2.0 Amp RoHS:否 制造商:Vishay Semiconductors 產(chǎn)品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復(fù)時間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel |
| G2D01D01024.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D01D01060.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D120-AA04-01 | 制造商:ebm-papst Inc 功能描述:G2D120-AA04-01 |
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