參數(shù)資料
型號(hào)： G2CORERM
英文描述： G2 Core Reference Manual
中文描述： G2核心參考手冊(cè)
文件頁(yè)數(shù)： 62/506頁(yè)
文件大小： 6720K
代理商： G2CORERM
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1-20
G2 PowerPC Core Reference Manual
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MOTOROLA
Implementation-Specific Information
breakpoint control (DBCR), a new instruction breakpoint register (IABR2), and two data
address breakpoint registers (DABR and DABR2) are added to the G2_LE core.
In the G2 core, all SPRs are 32 bits wide.
1.3.1.7.1
User-Level SPRs
The following SPRs are accessible by user-level software:
Link register (LR)—The LR can be used to provide the branch target address and to
hold the return address after branch and link instructions. The LR is 32 bits wide in
32-bit implementations.
Count register (CTR)—The CTR is decremented and tested automatically as a result
of branch-and-count instructions. The CTR is 32 bits wide in 32-bit
implementations.
XER register—The 32-bit XER contains the summary overflow bit, integer carry
bit, overflow bit, and a field specifying the number of bytes to be transferred by a
Load String Word Indexed (
lswx
) or Store String Word Indexed (
stswx
) instruction.
1.3.1.7.2
Supervisor-Level SPRs
The core also contains SPRs that can be accessed only by supervisor-level software. These
registers consist of the following:
The DSISR defines the cause of data access and alignment exceptions. The cause of
a DSI exception for a data breakpoint (match with DABR and DABR2) can be
determined by the value of the DSISR[DABR] bit (bit 9).
The data address register (DAR) holds the address of an access after an alignment
or DSI exception. For example, it contains the address of the breakpoint match
condition.
The decrementer register (DEC) is a 32-bit decrementing counter that provides a
mechanism for causing a decrementer exception after a programmable delay.
SDR1 specifies the page table format used in virtual-to-physical address translation
for pages. (Note that physical address is referred to as real address in the architecture
specification.)
The machine status save/restore register 0 (SRR0) is used for saving the address of
the instruction that caused the exception, and the address to return to when a Return
from Interrupt (
rfi
) instruction is executed.
The machine status save/restore register 1 (SRR1) is used to save machine status on
exceptions and to restore machine status when an
rfi
instruction is executed.
The SPRG0–SPRG3 registers are provided for operating system use, which reduce
the latency that may be incurred because of saving registers to memory while in a
handler. Note that G2_LE implements four additional SPRGs.
F
Freescale Semiconductor, Inc.
n
.
相關(guān)PDF資料
PDF描述
G2CORERMAD Errata to G2 PowerPC Core Reference Manual Rev. 0
G2RL-1
G2RL-14
G2RL-14-CF
G2RL-14-CFDC12
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
G2D 制造商:VISHAY 制造商全稱:Vishay Siliconix 功能描述:GLASS PASSIVATED JUNCTION RECTIFIER
G2D/4 功能描述:整流器 200 Volt 2.0 Amp RoHS:否 制造商:Vishay Semiconductors 產(chǎn)品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復(fù)時(shí)間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel
G2D01D01024.0 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY
G2D01D01060.0 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY
G2D120-AA04-01 制造商:ebm-papst Inc 功能描述:G2D120-AA04-01
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