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參數(shù)資料
| 型號： | G2CORERM |
| 英文描述： | G2 Core Reference Manual |
| 中文描述： | G2核心參考手冊 |
| 文件頁數(shù)： | 128/506頁 |
| 文件大?。?/td> | 6720K |
| 代理商： | G2CORERM |
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3-20
G2 PowerPC Core Reference Manual
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MOTOROLA
Instruction Set Summary
3.2.4.3.3
Register Indirect Integer Load Instructions
For integer load instructions, the byte, half word, word, or double word addressed by the
EA is loaded into
r
D. Many integer load instructions have an update form, in which
r
A is
updated with the generated effective address. For these forms, the EA is placed into
r
A and
the memory element (byte, half word, word, or double word) addressed by EA is loaded
into
r
D.
Implementation Note
—In some implementations, the load half word algebraic
instructions (
lha
and
lhax
) and the load with update (
lbzu
,
lbzux
,
lhzu
,
lhzux
,
lhau
,
lhaux
,
lwu
, and
lwux
) instructions may execute with greater latency than other types of load
instructions. In the G2 core, these instructions operate with the same latency as other load
instructions.
Table 3-14 lists the integer load instructions.
3.2.4.3.4
Integer Store Instructions
For integer store instructions, the contents of
r
S are stored into the byte, half word, word,
or double word in memory addressed by the effective address. Many store instructions have
Table 3-14. Integer Load Instructions
Name
Mnemonic
Operand Syntax
Load Byte and Zero
lbz
r
D
,
d(
r
A)
Load Byte and Zero Indexed
lbzx
r
D
,r
A
,r
B
Load Byte and Zero with Update
lbzu
r
D
,
d(
r
A)
Load Byte and Zero with Update Indexed
lbzux
r
D
,r
A
,r
B
Load Half Word Algebraic
lha
r
D
,
d(
r
A)
Load Half Word Algebraic Indexed
lhax
r
D
,r
A
,r
B
Load Half Word Algebraic with Update
lhau
r
D
,
d(
r
A)
Load Half Word Algebraic with Update
Indexed
lhaux
r
D
,r
A
,r
B
Load Half Word and Zero
lhz
r
D
,
d(
r
A)
Load Half Word and Zero Indexed
lhzx
r
D
,r
A
,r
B
Load Half Word and Zero with Update
lhzu
r
D
,
d(
r
A)
Load Half Word and Zero with Update Indexed
lhzux
r
D
,r
A
,r
B
Load Word and Zero
lwz
r
D
,
d(
r
A)
Load Word and Zero Indexed
lwzx
r
D
,r
A
,r
B
Load Word and Zero with Update
lwzu
r
D
,
d(
r
A)
Load Word and Zero with Update Indexed
lwzux
r
D
,r
A
,r
B
F
Freescale Semiconductor, Inc.
n
.
相關PDF資料 |
PDF描述 |
|---|---|
| G2CORERMAD | Errata to G2 PowerPC Core Reference Manual Rev. 0 |
| G2RL-1 | |
| G2RL-14 | |
| G2RL-14-CF | |
| G2RL-14-CFDC12 | |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| G2D | 制造商:VISHAY 制造商全稱:Vishay Siliconix 功能描述:GLASS PASSIVATED JUNCTION RECTIFIER |
| G2D/4 | 功能描述:整流器 200 Volt 2.0 Amp RoHS:否 制造商:Vishay Semiconductors 產(chǎn)品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復時間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel |
| G2D01D01024.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D01D01060.0 | 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY |
| G2D120-AA04-01 | 制造商:ebm-papst Inc 功能描述:G2D120-AA04-01 |
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