參數(shù)資料
型號(hào)： G2CORERM
英文描述： G2 Core Reference Manual
中文描述： G2核心參考手冊(cè)
文件頁(yè)數(shù)： 152/506頁(yè)
文件大?。?/td> 6720K
代理商： G2CORERM
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4-4
G2 PowerPC Core Reference Manual
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MOTOROLA
Instruction Cache Organization and Control
Figure 4-1. Instruction Cache Organization
4.2.2
Instruction Cache Fill Operations
The G2 core instruction cache blocks are loaded in four 64-bit beats, with the
critical-double-word loaded first. The instruction cache allows sequential fetching during a
cache block load. On a cache miss, the critical and following double words read from
memory are simultaneously written to the instruction cache and forwarded to the dispatch
queue, thus minimizing stalls due to cache fill latency. There is no snooping of the
instruction cache. In the G2 core, the critical-double-word is simultaneously written to the
cache and forwarded to the requesting unit, thus minimizing stalls due to load delays.
4.2.3
Instruction Cache Control
In addition to instruction cache control instructions, the G2 core provides several HID0 bits
to control invalidating, disabling, and locking the instruction cache. The WIMG bits in the
page tables and the IBATs also affect the cacheability of pages and whether the pages are
considered guarded.
4.2.3.1
Instruction Cache Invalidation
Although the G2 core instruction cache is automatically invalidated during a power-on or
hard reset, asserting core_sreset does not invalidate the instruction cache. Software can
invalidate the contents of the instruction cache using the instruction cache flash invalidate
control bit, HID0[ICFI]. Flash invalidation of the instruction cache is accomplished by
setting ICFI bit (invalidates the cache) and subsequently clearing the ICFI bit (enables
normal operation) in two consecutive
mtspr
[HID0] instructions.
Address Tag 1
Address Tag 2
Address Tag 3
Block 1
Block 2
Block 3
128 Sets
Address Tag 0
Block 0
8 Words/Block
State
State
State
Words 0–7
Words 0–7
Words 0–7
Words 0–7
State
F
Freescale Semiconductor, Inc.
n
.
相關(guān)PDF資料
PDF描述
G2CORERMAD Errata to G2 PowerPC Core Reference Manual Rev. 0
G2RL-1
G2RL-14
G2RL-14-CF
G2RL-14-CFDC12
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
G2D 制造商:VISHAY 制造商全稱(chēng):Vishay Siliconix 功能描述:GLASS PASSIVATED JUNCTION RECTIFIER
G2D/4 功能描述:整流器 200 Volt 2.0 Amp RoHS:否 制造商:Vishay Semiconductors 產(chǎn)品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復(fù)時(shí)間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel
G2D01D01024.0 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY
G2D01D01060.0 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY
G2D120-AA04-01 制造商:ebm-papst Inc 功能描述:G2D120-AA04-01
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