參數(shù)資料
型號(hào)： G2CORERM
英文描述： G2 Core Reference Manual
中文描述： G2核心參考手冊(cè)
文件頁(yè)數(shù)： 340/506頁(yè)
文件大小： 6720K
代理商： G2CORERM
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8-28
G2 PowerPC Core Reference Manual
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MOTOROLA
Signal Descriptions
High Impedance—Indicates that the core does not need the snooped
address tenure to be retired. Occurs two bus cycles after core_aack is
asserted, after the negation of core_artry_oe, if core_artry_tre is
asserted. If core_artry_tre is negated, core_artry_out is always
driven.
8.3.5.2.3
Address Retry Output Enable (core_artry_oe)—Output
core_artry_oe is an output-enable indicator to its corresponding bus signals. Following are
the state meaning and timing comments for core_artry_oe.
State Meaning
Asserted—Indicates that the G2 core is driving a valid
core_artry_out.
Negated—Indicates one of the following two conditions:
If core_artry_tre is negated, negated core_artry_oe indicates that the
core is not driving a valid core_artry_out value.
If core_artry_tre is asserted, negated core_artry_oe indicates that
core_artry_out is in the high-impedance state.
Timing Comments
Assertion—Asserted the second bus cycle following the assertion of
core_ts_in if a retry is required and it remains asserted until one bus
cycle after core_aack is asserted.
Negation—Occurs the second bus cycle after the assertion of
core_aack and remains asserted for a minimum of one-half bus cycle
(depends on clock mode) before it is negated for one bus cycle.
Note that negation of core_artry_oe may force core_artry_out to the
high-impedance state, if core_artry_tre is asserted.
8.3.5.2.4
Address Retry High-Impedance Enable (core_artry_tre)—Input
Following are the state meaning and timing comments for core_artry_tre. core_artry_tre is
a high-impedance enable signal on the G2 core and can be used to create an external
bidirectional core_artry signal. When the related input/output signals (core_artry_in and
core_artry_out) are wire-ORed together, the resulting signal functions similar to a
bidirectional 60x bus signal when core_artry_tre is asserted. See Section 8.2.2.2, “Logic
Gate Equivalent and Bidirectional Signals,” for more information.
State Meaning
Asserted—core_artry_oe controls whether core_artry_out is driven
or forced to a high-impedance state.
Negated—Indicates core_artry_out is always driven.
Timing Comments
Assertion/Negation—Must be set up prior to negation of the
core_hreset signal and remain stable during core operation. This is a
static configuration.
F
Freescale Semiconductor, Inc.
n
.
相關(guān)PDF資料
PDF描述
G2CORERMAD Errata to G2 PowerPC Core Reference Manual Rev. 0
G2RL-1
G2RL-14
G2RL-14-CF
G2RL-14-CFDC12
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
G2D 制造商:VISHAY 制造商全稱:Vishay Siliconix 功能描述:GLASS PASSIVATED JUNCTION RECTIFIER
G2D/4 功能描述:整流器 200 Volt 2.0 Amp RoHS:否 制造商:Vishay Semiconductors 產(chǎn)品:Standard Recovery Rectifiers 配置: 反向電壓:100 V 正向電壓下降: 恢復(fù)時(shí)間:1.2 us 正向連續(xù)電流:2 A 最大浪涌電流:35 A 反向電流 IR:5 uA 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:DO-221AC 封裝:Reel
G2D01D01024.0 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY
G2D01D01060.0 制造商:W L Gore & Associates 功能描述:RF STANDARD CABLE ASSEMBLY
G2D120-AA04-01 制造商:ebm-papst Inc 功能描述:G2D120-AA04-01
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